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CAST基于FPGAs和ASICs的視頻編碼器IP核現(xiàn)已上市
近日，由CAST公司提供的基于FPGAs和ASICs的H.264High Profile視頻編碼器IP核現(xiàn)已經(jīng)實現(xiàn)上市。高清H.264/AVC視頻編碼器核專為對高清視頻具有嚴(yán)格要求的HD廣播、專業(yè)攝像機、視頻刻錄等產(chǎn)品研制，具有出眾的視頻效果、
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基于IP核技術(shù)的SoC設(shè)計
1概述 隨著集成電路(Integrated Circuit,IC)設(shè)計技術(shù)和工藝水平進入超深亞微米,集成電路規(guī)模越來越大,芯片設(shè)計規(guī)模和設(shè)計復(fù)雜度也急劇提高,工藝流程呈現(xiàn)專業(yè)化,EDA設(shè)計逐步發(fā)展和完善。九十年代出現(xiàn)了SoC芯片,即可
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基于DDS IP核及Nios II的可重構(gòu)信號源設(shè)計
SOPC(System on a Programmable Chip，片上可編程系統(tǒng))是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器、存儲器、I／O接口、LVDS、CDR等系統(tǒng)設(shè)計需要的功能模塊集成到一個可編程邏輯器件上，構(gòu)建一個可
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基于DDS IP核及Nios II的可重構(gòu)信號源設(shè)計
基于DDS IP核及Nios II的可重構(gòu)信號源設(shè)計
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基于IP核的FIR低通濾波器的設(shè)計與實現(xiàn)
0.引言 FIR（Finite Impulse Response，有限沖擊響應(yīng)）數(shù)字濾波器具有穩(wěn)定性高、可以實現(xiàn)線性相位等優(yōu)點，廣泛被應(yīng)用于信號檢測與處理等領(lǐng)域[1,2]。由于FPGA（Field Programmable Gate Array，現(xiàn)場可編程門陣列）
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基于IP核的FPGA 設(shè)計方法
幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL
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Tensilica IP核出貨超20億顆 成為授權(quán)收入最高的DSP IP供應(yīng)商
10月15日，Tensilica宣布，其DPU（數(shù)據(jù)處理器）的授權(quán)出貨量突破20億顆。Tensilica授權(quán)廠商目前每年出貨約8億顆Tensilica DPU IP核，這較2011年6月DPU的出貨量突破10億顆時增長超過50%（參見新聞稿）。Tensilica同時
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基于快速傅里葉IP核的數(shù)字脈壓處理器的實現(xiàn)
引言 脈沖壓縮體制在現(xiàn)代雷達(dá)中被廣泛采用，通過發(fā)射寬脈沖來提高發(fā)射的平均功率，保證足夠的作用距離；接收時則采用相應(yīng)的脈沖壓縮算法獲得脈寬較窄的脈沖，以提高距離分辨力，從而能夠很好地解決作用距離和距離
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基于Q-Coder算術(shù)編碼器IP核的設(shè)計
1 概述JPEG2000[1,2]是新的靜止圖像壓縮標(biāo)準(zhǔn)，它具有的多種特性使得它有著廣泛的應(yīng)用前景。目前為止，JPEG2000的解決方案比較少，并且其中的絕大部分是軟件解決方案：Jasper[3]軟件是經(jīng)IEC JTC1/SC29/WG1小組推薦使用
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CAN總線控制器IP核的代碼分析
include "timescale.v"// synopsys translate_on`include "can_defines.v"module can_top(`ifdef CAN_WISHBONE_IFwb_clk_i,wb_rst_i,wb_dat_i,wb_dat_o,wb_cyc_i,wb_stb_i,wb_we_i,wb_adr_i,wb_ack_o,`elserst_i,ale
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Tensilica成為全球授權(quán)收入最高的DSP IP供應(yīng)商
Tensilica成為全球授權(quán)收入最高的DSP IP供應(yīng)商
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全功能硬件掃描鍵盤控制器IP核的實現(xiàn)
IP（Intellectual Property），即常說的知識產(chǎn)權(quán)。在PLD領(lǐng)域中，IP核是指將數(shù)字系統(tǒng)中常用但比較復(fù)雜的一些功能塊設(shè)計成參數(shù)可調(diào)并以HDL源文件或加密網(wǎng)表形式存在的可供其他用戶直接調(diào)用的軟件模塊。由于已經(jīng)過嚴(yán)格的
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CAN總線控制器的IP核代碼
include "timescale.v"// synopsys translate_on`include "can_defines.v" module can_top( `ifdef CAN_WISHBONE_IF wb_clk_i, wb_rst_i, wb_dat_i, wb_dat_o, wb_cyc_i, wb_stb_i, wb_we_i,
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基于Q-Coder算術(shù)編碼器的IP核設(shè)計與仿真
1 概述 JPEG2000[1,2]是新的靜止圖像壓縮標(biāo)準(zhǔn)，它具有的多種特性使得它有著廣泛的應(yīng)用前景。目前為止，JPEG2000的解決方案比較少，并且其中的絕大部分是軟件解決方案：Jasper[3]軟件是經(jīng)IEC JTC1/SC29/WG1小組推薦
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基于SJA1000 IP核的CAN總線通信系統(tǒng)
摘要：分析了CAN總線控制器的工作原理，以SJA1000為模型，提出基于SOPC技術(shù)的CAN總線控制器的設(shè)計方案，并完成SJA1000 IP核的設(shè)計；完成了在Altcra的Cyclone III型FPGA芯片上集成微處理器核、SJA1000 IP核、數(shù)據(jù)RAM、
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基于BIST的IP核測試方案設(shè)計
1 引言 隨著半導(dǎo)體工藝的發(fā)展，片上系統(tǒng)SOC已成為當(dāng)今一種主流技術(shù)。基于IP復(fù)用的SOC設(shè)計是通過用戶自定義邏輯(UDL)和連線將IP核整合為一個系統(tǒng)，提高了設(shè)計效率，加快了設(shè)計過程，縮短了產(chǎn)品上市時間。但是隨著設(shè)
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基于SJA1000 IP核的CAN總線通信系統(tǒng)
基于SJA1000 IP核的CAN總線通信系統(tǒng)
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跨數(shù)據(jù)中心二層網(wǎng)絡(luò)——H3C云間互聯(lián)解決方案
數(shù)據(jù)中心間通常部署以下三種互聯(lián)鏈路，每種互聯(lián)鏈路所承載的數(shù)據(jù)不同，實現(xiàn)的功能不同，如下圖所示：三層互聯(lián)。也稱為數(shù)據(jù)中心前端網(wǎng)絡(luò)互聯(lián)，所謂“前端網(wǎng)絡(luò)”是指數(shù)據(jù)中心面向企業(yè)園區(qū)網(wǎng)或企業(yè)廣域網(wǎng)的出
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跨數(shù)據(jù)中心二層網(wǎng)絡(luò)——H3C云間互聯(lián)解決方案
數(shù)據(jù)中心間通常部署以下三種互聯(lián)鏈路，每種互聯(lián)鏈路所承載的數(shù)據(jù)不同，實現(xiàn)的功能不同，如下圖所示：三層互聯(lián)。也稱為數(shù)據(jù)中心前端網(wǎng)絡(luò)互聯(lián)，所謂“前端網(wǎng)絡(luò)”是指數(shù)據(jù)中心面向企業(yè)園區(qū)網(wǎng)或企業(yè)廣域網(wǎng)的出
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Altera以太網(wǎng)路IP核心 降低FPGA設(shè)計難度
Altera推出40Gbit/s乙太網(wǎng)路(40GbE)和100Gbit/s乙太網(wǎng)路(100GbE)矽智財(IP)核心產(chǎn)品。這些核心能高效率的建構(gòu)需大傳輸量標(biāo)準(zhǔn)乙太網(wǎng)路連接的系統(tǒng)，包括晶片至光模組、晶片至晶片及背板應(yīng)用等。Altera媒體存取控制(MAC
