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跨數(shù)據(jù)中心二層網(wǎng)絡(luò)——H3C云間互聯(lián)解決方案
數(shù)據(jù)中心間通常部署以下三種互聯(lián)鏈路，每種互聯(lián)鏈路所承載的數(shù)據(jù)不同，實(shí)現(xiàn)的功能不同，如下圖所示：三層互聯(lián)。也稱(chēng)為數(shù)據(jù)中心前端網(wǎng)絡(luò)互聯(lián)，所謂“前端網(wǎng)絡(luò)”是指數(shù)據(jù)中心面向企業(yè)園區(qū)網(wǎng)或企業(yè)廣域網(wǎng)的出
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跨數(shù)據(jù)中心二層網(wǎng)絡(luò)——H3C云間互聯(lián)解決方案
數(shù)據(jù)中心間通常部署以下三種互聯(lián)鏈路，每種互聯(lián)鏈路所承載的數(shù)據(jù)不同，實(shí)現(xiàn)的功能不同，如下圖所示：三層互聯(lián)。也稱(chēng)為數(shù)據(jù)中心前端網(wǎng)絡(luò)互聯(lián)，所謂“前端網(wǎng)絡(luò)”是指數(shù)據(jù)中心面向企業(yè)園區(qū)網(wǎng)或企業(yè)廣域網(wǎng)的出
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Altera以太網(wǎng)路IP核心 降低FPGA設(shè)計(jì)難度
Altera推出40Gbit/s乙太網(wǎng)路(40GbE)和100Gbit/s乙太網(wǎng)路(100GbE)矽智財(cái)(IP)核心產(chǎn)品。這些核心能高效率的建構(gòu)需大傳輸量標(biāo)準(zhǔn)乙太網(wǎng)路連接的系統(tǒng)，包括晶片至光模組、晶片至晶片及背板應(yīng)用等。Altera媒體存取控制(MAC
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基于SOPC的紅外解碼IP核設(shè)計(jì)與實(shí)現(xiàn)
摘要：提出一種紅外解碼IP核在SoPC系統(tǒng)中的設(shè)計(jì)與實(shí)現(xiàn)方案，重點(diǎn)研究紅外系統(tǒng)的數(shù)據(jù)編碼和傳輸機(jī)制，紅外解碼電路的HDL設(shè)計(jì)，IP核的制作及在SoPC系統(tǒng)中的應(yīng)用。該方案的紅外發(fā)送接收芯片分別是TC9012和DS338S，在DE2
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基于SOPC的紅外解碼IP核設(shè)計(jì)與實(shí)現(xiàn)
基于SOPC的紅外解碼IP核設(shè)計(jì)與實(shí)現(xiàn)
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TAKUMI 圖象IP核參考設(shè)計(jì)可用于S2C原型驗(yàn)證平臺(tái)
21ic訊 S2C宣布，一家總部位于日本的高級(jí)圖形知識(shí)產(chǎn)權(quán)（IP）供應(yīng)商，TAKUMI 公司，已成功在S2C基于FPGA的快速原型驗(yàn)證系統(tǒng)上實(shí)現(xiàn)了一系列圖形IP核，包括GS3000和GSV3000 IP核。這些TAKUMI IP核已在FPGA里充分驗(yàn)證，可
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電子及電工測(cè)試技術(shù)的發(fā)展趨勢(shì)分析
導(dǎo)讀：這些年來(lái)，由于產(chǎn)品的設(shè)計(jì)的高精度和高性能產(chǎn)品對(duì)元器件的質(zhì)量有比較高的要求，因此元器件等產(chǎn)品的高可靠性就成為人們考考慮的主要問(wèn)題，處于對(duì)這種情況的考慮，基于目前測(cè)試技術(shù)的提高，我們將探討一下將來(lái)各
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CAST公司宣布對(duì)JPEG編碼器IP核進(jìn)行優(yōu)化
半導(dǎo)體IP供應(yīng)商CAST公司今日宣布對(duì)其提供的JPEG編碼器IP核進(jìn)行功能及性能優(yōu)化。系統(tǒng)設(shè)計(jì)師現(xiàn)在有兩個(gè)速率控制選項(xiàng)可以選擇，用于調(diào)試JPEG壓縮功能的特定應(yīng)用程序：·有限緩沖，基于模塊的速率控制可為緩沖和傳
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AMBA總線SoC系統(tǒng)IP核的即插即用研究
AMBA總線SoC系統(tǒng)IP核的即插即用研究
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基于VHDL語(yǔ)言的IP核驗(yàn)證
引言 在IC(integrated circuit．集成電路)發(fā)展到超大規(guī)模階段的今天，基于IP(Intellectual Property，知識(shí)產(chǎn)權(quán))核的IC設(shè)計(jì)及其再利用是保證SoC(system onchip，片上系統(tǒng))開(kāi)發(fā)效率和質(zhì)量的重要手段。如果能
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基于VHDL語(yǔ)言的IP核驗(yàn)證
基于VHDL語(yǔ)言的IP核驗(yàn)證
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Xilinx豐富 FEC IP核鼎助網(wǎng)絡(luò)運(yùn)營(yíng)商降低運(yùn)營(yíng)和資本支出
21ic訊 賽靈思公司在摩納哥格里馬爾迪會(huì)議中心舉行的 2012 年 WDM 和下一代光網(wǎng)絡(luò)大會(huì)上宣布推出前向糾錯(cuò) (FEC) IP 核的延伸系列。該系列產(chǎn)品包括 GFEC、eFEC 和高增益 FEC（xFEC）解決方案，用于控制信號(hào)傳輸錯(cuò)誤，
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Xilinx推出前向糾錯(cuò)IP核的延伸系列
21ic訊 賽靈思公司（Xilinx, Inc.）在摩納哥格里馬爾迪會(huì)議中心舉行的 2012 年 WDM 和下一代光網(wǎng)絡(luò)大會(huì)上宣布推出前向糾錯(cuò) (FEC) IP 核的延伸系列。該系列產(chǎn)品包括 GFEC、eFEC 和高增益 FEC（xFEC）解決方案，用于控
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關(guān)于quartus生成IP核的仿真出錯(cuò)問(wèn)題的解決
對(duì)MegaCore的生成從頭至尾操作了一遍，說(shuō)實(shí)話很是復(fù)雜，不過(guò)，大家都知道quartus的IP可以直接拿來(lái)用的，大大節(jié)省了開(kāi)發(fā)時(shí)間，而且其代碼是絕對(duì)優(yōu)化的;所有的前奏都操作成功，設(shè)置沒(méi)什么問(wèn)題，開(kāi)始對(duì)生成的fft.vhd文件
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關(guān)于quartus生成IP核的仿真出錯(cuò)問(wèn)題的解決
關(guān)于quartus生成IP核的仿真出錯(cuò)問(wèn)題的解決
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基于FPGA的DDS IP核設(shè)計(jì)
摘要：以Altera公司的QuartusⅡ7．2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟
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電子電工測(cè)試技術(shù)的發(fā)展趨勢(shì)
導(dǎo)讀：這些年來(lái)，由于產(chǎn)品的設(shè)計(jì)的高精度和高性能產(chǎn)品對(duì)元器件的質(zhì)量有比較高的要求，因此元器件等產(chǎn)品的高可靠性就成為人們考考慮的主要問(wèn)題，處于對(duì)這種情況的考慮，基于目前測(cè)試技術(shù)的提高，我們將探討一下將來(lái)各
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基于FPGA的DDS IP核設(shè)計(jì)
基于FPGA的DDS IP核設(shè)計(jì)
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使用LabVIEW FPGA模塊設(shè)計(jì)IP核
對(duì)于利用LabVIEW FPGA實(shí)現(xiàn)RIO目標(biāo)平臺(tái)上的定制硬件的工程師與開(kāi)發(fā)人員，他們可以很容易地利用所推薦的組件設(shè)計(jì)構(gòu)建適合其應(yīng)用的、可復(fù)用且可擴(kuò)展的代碼模塊?；谝呀?jīng)驗(yàn)證的設(shè)計(jì)進(jìn)行代碼模塊開(kāi)發(fā)，將使現(xiàn)有IP在未來(lái)應(yīng)
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采用NioslI的SOPC系統(tǒng)的LCD顯示驅(qū)動(dòng)IP核方案設(shè)計(jì)
采用NioslI的SOPC系統(tǒng)的LCD顯示驅(qū)動(dòng)IP核方案設(shè)計(jì)
- 得捷芯聞解碼研習(xí)站第二期：傳感器賦予設(shè)備感知萬(wàn)物之力
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