FPGA
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基于改進(jìn)的布斯算法FPGA嵌入式18×18乘法器
摘要：設(shè)計(jì)了一款嵌入FPGA的乘法器，該乘法器能夠滿(mǎn)足兩個(gè)18 b有符號(hào)或17 b無(wú)符號(hào)數(shù)的乘法運(yùn)算。該設(shè)計(jì)基于改進(jìn)的布斯算法，提出了一種新的布斯譯碼和部分積結(jié)構(gòu)，并對(duì)9-2壓縮樹(shù)和超前進(jìn)位加法器進(jìn)行了優(yōu)化。該乘法器
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基于FPGA的FFT算法優(yōu)化及其在磁共振譜儀中的應(yīng)用
摘要：提出了一種基于FPGA的依據(jù)核磁共振譜儀雙通道頻譜圖對(duì)其信號(hào)增益和相位差不平衡進(jìn)行調(diào)節(jié)的設(shè)計(jì)方案，詳細(xì)闡述了FFT算法在FPGA中的設(shè)計(jì)與實(shí)現(xiàn)方法。該模塊中的FFT處理器通過(guò)多個(gè)64點(diǎn)并行FFT模塊復(fù)用實(shí)現(xiàn)，復(fù)數(shù)乘
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基于FPGA高階FIR濾波器的實(shí)現(xiàn)
摘要：從FIR數(shù)字濾波器的基本結(jié)構(gòu)模型出發(fā)，分析了FIR濾波器的設(shè)計(jì)思路及具體實(shí)現(xiàn)方法，詳細(xì)介紹了FIR濾波器的分布式算法(DA)結(jié)構(gòu)。通過(guò)分析計(jì)算，得到普通DA結(jié)構(gòu)實(shí)現(xiàn)高階濾波器會(huì)消耗大量的查找表資源，這樣的資源消
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基于FPGA的圖像采集模塊設(shè)計(jì)
基于FPGA的圖像采集模塊設(shè)計(jì)
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基于FPGA的圖像采集模塊設(shè)計(jì)
基于FPGA的圖像采集模塊設(shè)計(jì)
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基于FPGA的高速AD轉(zhuǎn)換
摘要：在雷達(dá)設(shè)計(jì)中，需要對(duì)接收到的信號(hào)首先進(jìn)行模數(shù)轉(zhuǎn)換，其轉(zhuǎn)換速度和準(zhǔn)確性直接決定了之后FFT等運(yùn)算的準(zhǔn)確性，最終影響雷達(dá)測(cè)量精度。介紹了一種基于FPGA，利用芯片ADS7890實(shí)現(xiàn)一種快速14位串行AD轉(zhuǎn)換，對(duì)系統(tǒng)的
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基于FPGA的高速AD轉(zhuǎn)換
摘要：在雷達(dá)設(shè)計(jì)中，需要對(duì)接收到的信號(hào)首先進(jìn)行模數(shù)轉(zhuǎn)換，其轉(zhuǎn)換速度和準(zhǔn)確性直接決定了之后FFT等運(yùn)算的準(zhǔn)確性，最終影響雷達(dá)測(cè)量精度。介紹了一種基于FPGA，利用芯片ADS7890實(shí)現(xiàn)一種快速14位串行AD轉(zhuǎn)換，對(duì)系統(tǒng)的
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FPGA迎來(lái)硅片融合時(shí)代
“從上世紀(jì)90年代開(kāi)始，F(xiàn)PGA經(jīng)歷了快速發(fā)展、短期的經(jīng)濟(jì)泡沫破裂、平穩(wěn)增長(zhǎng)幾個(gè)過(guò)程，即將進(jìn)入硅片融合時(shí)代。” Altera公司資深副總裁，首席技術(shù)官M(fèi)isha Burich博士如是說(shuō)。Misha Burich博士解釋說(shuō)，起初，
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小型化低功耗數(shù)字信號(hào)處理器設(shè)計(jì)
摘要：隨著電子技術(shù)的不斷進(jìn)步，一些原本只能安裝在較大平臺(tái)的通信設(shè)備通過(guò)小型化、低功耗設(shè)計(jì)已經(jīng)能夠加裝在較小的平臺(tái)上，而通信設(shè)備的加裝會(huì)使這些平臺(tái)的信息化程度大幅提升，從而適應(yīng)更多的應(yīng)用場(chǎng)合。為了實(shí)現(xiàn)通
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基于DSP+FPGA的高精度程控交流電源設(shè)計(jì)
摘要：介紹了一種基于DSP+FPGA芯片技術(shù)的高精度程控交流電源的實(shí)現(xiàn)方法，利用FPGA實(shí)現(xiàn)了任意波形發(fā)生功能，并對(duì)功率逆變等電路進(jìn)行了詳細(xì)的分析和設(shè)計(jì)，最后給出了實(shí)驗(yàn)結(jié)果以及相關(guān)波形。關(guān)鍵詞：交流電源；程控；任
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基于FPGA的運(yùn)動(dòng)估計(jì)設(shè)計(jì)
摘要：利用功能強(qiáng)大的FPGA實(shí)現(xiàn)視頻圖像的一種運(yùn)動(dòng)估計(jì)設(shè)計(jì)，采用的搜索方法是三步搜索法。在進(jìn)行方案設(shè)計(jì)時(shí)，本文采用了技術(shù)比較成熟的VHDL語(yǔ)言進(jìn)行設(shè)計(jì)，并使用Quartus II軟件進(jìn)行時(shí)序仿真。由仿真結(jié)果可知，無(wú)論是
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FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
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采用FPGA解決通信接口問(wèn)題
引言 在過(guò)去兩年里,用于消除IC、電路板和系統(tǒng)之間數(shù)據(jù)傳輸瓶頸的接口標(biāo)準(zhǔn)層出不窮,本文將考評(píng)通信應(yīng)用標(biāo)準(zhǔn)部件的某些最流行的標(biāo)準(zhǔn),并研究眾多新標(biāo)準(zhǔn)出現(xiàn)的原因,此外還探討設(shè)計(jì)者可如何解決互用性的難題。 新興
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采用FPGA解決通信接口問(wèn)題
采用FPGA解決通信接口問(wèn)題
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基于FPGA的中文字符顯示的VHDL程序
基于FPGA的中文字符顯示的VHDL程序
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用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程
用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程
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基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)
本文設(shè)計(jì)一款基于FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)的液晶電視動(dòng)態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流?！ ‰娨晞?dòng)態(tài)背光 以往的電視機(jī)主板將圖像信號(hào)通過(guò)LVDS(LowVoltageDifferentialSignal，低
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基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)
本文設(shè)計(jì)一款基于FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)的液晶電視動(dòng)態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流。 電視動(dòng)態(tài)背光 以往的電視機(jī)主板將圖像信號(hào)通過(guò)LVDS(LowVoltageDifferentialSignal，低
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基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)
基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)
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基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn)
基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn)
