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基于數字移相的高精度脈寬測量系統(tǒng)及其FPGA實現
在測量與儀器儀表領域,經常需要對數字信號的脈沖寬度進行測量.這種測量通常采用脈沖計數法,即在待測信號的高電平或低電平用一高頻時鐘脈沖進行計數,然后根據脈沖的個數計算待測信號寬度,如圖1所示.待測信號相對于
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級聯(lián)信號處理器的FPGA實現
摘要：現代通信系統(tǒng)中，數字化已成為發(fā)展的必然趨勢，數字信號處理則是數字系統(tǒng)中的重要環(huán)節(jié)。在數字信號處理方面提出一種級聯(lián)信號處理器的FPGA實現方案，用以取代昂貴的專用數字處理芯片。首先對級聯(lián)信號處理器做了
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一種高速幀同步和相位模糊估計的方法及其FPGA實現
摘要：提出僅依靠接收符號和本地同步碼快速確定MPSK調制符號的幀同步，并同時估計其相位模糊值的計算方法，給出減少一半計算量的簡化相關算法以及設是兩個門限的方法，并分析該同步器的性能。詳細設計能估計相位模糊
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改進型CIC抽取濾波器設計與FPGA實現
摘 要：為了改善級聯(lián)積分梳狀(CIC)濾波器通帶不平和阻帶衰減不足的缺點，給出一種改進型CIC濾波器。該濾波器在采用 COSINE濾波器提高阻帶特性的基礎上，級聯(lián)了一個SINE濾波器，補償了其通帶衰減。硬件實現時，采用新
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積分梳狀濾波器的FPGA實現
本文提出了多級CIC抽取濾波器結構不僅能夠實現更寬輸入信號的任意速率的抽取，并且對帶外信號的衰減也更大。
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積分梳狀濾波器的FPGA實現
本文提出了多級CIC抽取濾波器結構不僅能夠實現更寬輸入信號的任意速率的抽取，并且對帶外信號的衰減也更大。
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DDS信號源的FPGA實現
1 引言 目前直接數字頻率合成DDS專用器件大多采用先進特定工藝技術，并具有高性能，多功能，且其內部數字信號抖動?。敵鲂盘柕馁|量高等特點，諸如Qualcomm公司的Q2230、Q2334，Analog Device公司的AD9955、AD
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單精度浮點加法器的FPGA實現
摘 要：在FPGA上實現單精度浮點加法器的設計，通過分析實數的IEEE 754表示形式和IEEE 754單精度浮點的存儲格式，設計出一種適合在FPGA上實現單精度浮點加法運算的算法處理流程，依據此算法處理流程劃分的各個處理模塊
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20×18位符號定點乘法器的FPGA實現
摘要：在數字信號處理中經常需要進行乘法運算，乘法器的設計對整個器件的性能有很大的影響，在此介紹20×18比特定點陣列乘法器的設計。采用基4-Booth算法和4-2壓縮的方案，并采用先進的集成電路工藝，使用SMIC O．18
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單精度浮點加法器的FPGA實現
摘 要：在FPGA上實現單精度浮點加法器的設計，通過分析實數的IEEE 754表示形式和IEEE 754單精度浮點的存儲格式，設計出一種適合在FPGA上實現單精度浮點加法運算的算法處理流程，依據此算法處理流程劃分的各個處理模塊
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20×18位符號定點乘法器的FPGA實現
摘要：在數字信號處理中經常需要進行乘法運算，乘法器的設計對整個器件的性能有很大的影響，在此介紹20×18比特定點陣列乘法器的設計。采用基4-Booth算法和4-2壓縮的方案，并采用先進的集成電路工藝，使用SMIC O．18
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基于Logistic映射PN序列的FPGA實現
為了獲得性能良好，適于擴頻通信及加密領域的偽噪聲(PN)序列，提出了一種PN序列量化產生及硬件實現方法。該方法基于FPGA技術并以Logistic離散映射作為隨機信號源，提取Logistic映射時間序列二進制數中的某一位構成了一個新的混沌PN序列，并在硬件上獲得了實現。通過對序列的頻率測試、串列測試、Poker測試、游程測試、自相關測試表明，這種PN序列的硬件實現技術可為擴頻通信和信息加密提供一個良好的偽噪聲序列。
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基于Logistic映射PN序列的FPGA實現
為了獲得性能良好，適于擴頻通信及加密領域的偽噪聲(PN)序列，提出了一種PN序列量化產生及硬件實現方法。該方法基于FPGA技術并以Logistic離散映射作為隨機信號源，提取Logistic映射時間序列二進制數中的某一位構成了一個新的混沌PN序列，并在硬件上獲得了實現。通過對序列的頻率測試、串列測試、Poker測試、游程測試、自相關測試表明，這種PN序列的硬件實現技術可為擴頻通信和信息加密提供一個良好的偽噪聲序列。
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采用FPGA實現音頻模數轉換器
摘 要 簡要分析sigma—deIta(∑一△)架構模數轉換器(ADC)原理，提出一種基于FPGA內部LVDS(Low Voltage Differential Signaling)接收器的音頻ADC架構，并給出在FPGA上的實現結果。在FPGA內部實現音頻ADC，具有擴展方便
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ADSP TS201鏈路口通信的FPGA實現
O 引 言 隨著電子技術的飛速發(fā)展，在實際應用中數據高速傳輸有著越來越高的要求，鏈路口為數據傳送提供了高速、獨立的通信機制，得到廣泛應用。AD公司生產的TS201 DSP就具備這種端口。為了使不具備此接口的器件
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1553B總線遠程端點數據鏈路層協(xié)議的FPGA實現
0 引 言 用于車輛、艦船、飛機等機動平臺上的電子設備越來越多，并且越來越復雜。將電子設備加以有效的綜合，使之達到資源和功能共享已成為必然趨勢。電子綜合的支撐技術是聯(lián)網技術，而機動平臺上的聯(lián)網技術不同
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數字直放站中CPRI協(xié)議的FPGA實現
為了開發(fā)數字直放站連接系統(tǒng)，介紹CPRI協(xié)議規(guī)范和幀結構，討論其硬件上的實現方案，給出基于SCAN25100的FPGA電路模塊設計，采用Verilog語言設計開發(fā)功能模塊。該方案具有便于功能擴展、成本低、使用靈活等特點，通過實際測試表明，此方案可進行可靠的數據傳輸，性能穩(wěn)定，從而實現了數字直放站和基站之間更有效的互通，擴大了基站的覆蓋范圍。
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采用FPGA實現音頻模數轉換器
摘 要 簡要分析sigma—deIta(∑一△)架構模數轉換器(ADC)原理，提出一種基于FPGA內部LVDS(Low Voltage Differential Signaling)接收器的音頻ADC架構，并給出在FPGA上的實現結果。在FPGA內部實現音頻ADC，具有擴展方便
