FPGA
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基于DSP與FPGA的全姿態(tài)指引儀的設(shè)計(jì)
基于DSP與FPGA的全姿態(tài)指引儀的設(shè)計(jì)
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基于FPGA的RGB到Y(jié)CrCb顏色空間轉(zhuǎn)換
RGB基于三基色原理，顏色實(shí)現(xiàn)簡(jiǎn)單，在計(jì)算機(jī)、電視機(jī)顯示系統(tǒng)中應(yīng)用廣泛，YCrCb將顏色的亮度信號(hào)與色度信號(hào)分離，易于實(shí)現(xiàn)壓縮，方便傳輸和處理。在視頻壓縮、傳輸?shù)葢?yīng)用中經(jīng)常需要實(shí)現(xiàn)RGB與YCbCr顏色空間的相互變換。這里推導(dǎo)出一種適合在FPGA上實(shí)現(xiàn)從RGB到Y(jié)CbCr。顏色空間變換的新算法，采用單片F(xiàn)PGA完成電路設(shè)計(jì)，利用FPGA內(nèi)嵌DSP核實(shí)現(xiàn)乘法運(yùn)算，提高了轉(zhuǎn)換算法的運(yùn)行速度。
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基于FPGA平臺(tái)的抗DPA攻擊電路級(jí)防護(hù)技術(shù)研究
隨著現(xiàn)場(chǎng)可編程門陣列(FPGA)，芯片在安全領(lǐng)域上的廣泛應(yīng)用，有關(guān)FPGA密碼芯片的抗(DPA)研究也越來(lái)越受關(guān)注，但目前的研究成果大多針對(duì)智能卡的安全防護(hù)。在研究各種電路級(jí)安全防護(hù)技術(shù)的基礎(chǔ)上，采用硬件宏的方法將雙軌和預(yù)充電技術(shù)應(yīng)用于FPGA芯片的數(shù)據(jù)加密標(biāo)準(zhǔn)算法(DES)硬件結(jié)構(gòu)，通過(guò)DPA攻擊實(shí)驗(yàn)后發(fā)現(xiàn)，未加防護(hù)措施的DES加密系統(tǒng)難以抵御DPA攻擊，而加防護(hù)措施的加密系統(tǒng)具有抗DPA攻擊的能力。
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中國(guó)的"技術(shù)圈"
技術(shù)在社會(huì)公眾的眼里，往往很神秘。但是在中國(guó)特定的人群中，技術(shù)也可以成為輕松的聊天話題。 舉個(gè)例子，在葡萄的許多文章中，談到技術(shù)，經(jīng)常就可以發(fā)現(xiàn)這種神秘感。例如主席居住的象計(jì)算機(jī)陣列的房子。
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Quartus® II開(kāi)發(fā)軟件10.0版（Altera）
Altera公司今天宣布推出可編程邏輯業(yè)界的頂級(jí)軟件Quartus® II開(kāi)發(fā)軟件10.0版，為其CPLD、FPGA以及HardCopy® ASIC設(shè)計(jì)提供最高的性能和生產(chǎn)效率。Quartus II軟件10.0版可以為高密度設(shè)計(jì)提供比主要競(jìng)爭(zhēng)對(duì)手快2
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基于FPGA控制的溫度檢測(cè)無(wú)線發(fā)射接收系統(tǒng)
摘要：本文介紹基于FPGA控制的溫度檢測(cè)無(wú)線發(fā)射接收系統(tǒng)。本系統(tǒng)采甩EPlKl000C208-3作為控制核心，系統(tǒng)比較溫度是否超出人體最佳溫度范圍，如果過(guò)高則發(fā)出降溫信號(hào)，如果過(guò)低則發(fā)出升溫信號(hào)；得出需要加溫還是降溫的
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基于FPGA的任意波形發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)
摘要：本文提出了一種基于可編程邏輯器件(FPGA)芯片EP2C20F484的任意波形發(fā)生器的設(shè)計(jì)方法。完成了在FPGA的控制下，USB接口控制模塊、SRAM控制模塊、DA轉(zhuǎn)換模塊等協(xié)同工作的硬件設(shè)計(jì)、固件設(shè)計(jì)以及軟件設(shè)計(jì)，并給出了
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FPGA的功耗概念與低功耗設(shè)計(jì)研究
隨著半導(dǎo)體工藝的飛速發(fā)展和芯片工作頻率的提高，芯片的功耗迅速增加，而功耗增加又導(dǎo)致芯片發(fā)熱量的增大和可靠性的下降。因此，功耗已經(jīng)成為深亞微米集成電路設(shè)計(jì)中的一個(gè)重要考慮因素。本文圍繞FPGA功率損耗的組成和產(chǎn)生原理，從靜態(tài)功耗、動(dòng)態(tài)功耗兩大方面出發(fā)，分析了影響FPGA功率耗散的各種因素，并通過(guò)Actel產(chǎn)品中一款低功耗的FPGA進(jìn)一步進(jìn)行說(shuō)明。最后提出了在FPGA低功耗設(shè)計(jì)中的一些問(wèn)題。
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controller_4G08的方案設(shè)計(jì) 實(shí)現(xiàn)了FPGA對(duì)Flash的控制
本文設(shè)計(jì)了一個(gè)Flash控制器controller_4G08，它建立了自己的指令集，可以方便地實(shí)現(xiàn)FPGA對(duì)Flash的控制和讀寫(xiě)操作。FPGA主狀態(tài)機(jī)可以在系統(tǒng)時(shí)鐘頻率下對(duì)controller_4G08發(fā)送指令，然后等待controller_4G08返回的中斷
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基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)的設(shè)計(jì)
基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)的設(shè)計(jì)
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基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)的設(shè)計(jì)
基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)的設(shè)計(jì)
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Quartus® II開(kāi)發(fā)軟件10.0版（Altera）
Altera公司今天宣布推出可編程邏輯業(yè)界的頂級(jí)軟件Quartus® II開(kāi)發(fā)軟件10.0版，為其CPLD、FPGA以及HardCopy® ASIC設(shè)計(jì)提供最高的性能和生產(chǎn)效率。Quartus II軟件10.0版可以為高密度設(shè)計(jì)提供比主要競(jìng)爭(zhēng)對(duì)手快2
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Quartus® II開(kāi)發(fā)軟件10.0版（Altera）
Quartus® II開(kāi)發(fā)軟件10.0版（Altera）
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FPGA低功耗設(shè)計(jì)須權(quán)衡多項(xiàng)指標(biāo)
FPGA的功耗高度依賴于用戶的設(shè)計(jì)，沒(méi)有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的設(shè)計(jì)就是一種協(xié)調(diào)和平衡藝術(shù)，在進(jìn)行低功耗器件的設(shè)計(jì)時(shí)，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密
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基于Xilinx FPGA的千兆以太網(wǎng)及E1信號(hào)的光纖傳輸
本文設(shè)計(jì)的基于Xilinx FPGA的千兆位以太網(wǎng)及E1信號(hào)的光纖傳輸系統(tǒng)采用Xilinx XC5VLX30T芯片，通過(guò)以太網(wǎng)測(cè)試儀和數(shù)據(jù)誤碼儀對(duì)本系統(tǒng)分別進(jìn)行性能測(cè)試，測(cè)試結(jié)果滿足設(shè)計(jì)要求，系統(tǒng)工作穩(wěn)定。從而實(shí)現(xiàn)了千兆位以太網(wǎng)信號(hào)和E1信號(hào)的接入功能，為用戶搭建了一個(gè)大容量、多業(yè)務(wù)的傳輸平臺(tái)。
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基于FPGA的Viterbi譯碼器設(shè)計(jì)
摘要：卷積碼及其Viterbi譯碼是現(xiàn)代通信系統(tǒng)中常用的一種信道編碼方法。文中介紹了Viterbi譯碼算法的原理，分析了Viterbi譯碼器的結(jié)構(gòu)，然后用Verilog語(yǔ)言設(shè)計(jì)了一種基于Altera公司的EP3C120F780C8芯片的(2，l，7)Vi
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基于FPGA的LDPC編碼設(shè)計(jì)
針對(duì)低密度奇偶校驗(yàn)碼(簡(jiǎn)稱LDPC碼)的直接編碼運(yùn)算量較大、復(fù)雜度高，根據(jù)RicIlarclson和Urbanke(RU)建議的編碼方案，介紹一種適于在FPGA上實(shí)現(xiàn)，利用有效校驗(yàn)矩陣來(lái)降低編碼復(fù)雜度的LDPC編碼方案，給出了編碼器設(shè)計(jì)實(shí)現(xiàn)的原理和編碼器的結(jié)構(gòu)和基本組成。在QuartusⅡ7．2軟件平臺(tái)上采用基于FPGA的VHDL語(yǔ)言實(shí)現(xiàn)了有效的編碼過(guò)程。結(jié)果表明：此方案在保證高效可靠傳輸?shù)耐瑫r(shí)降低了實(shí)現(xiàn)的復(fù)雜度。這種編碼方案可靈活應(yīng)用于不同的校驗(yàn)矩陣H，碼長(zhǎng)和碼率的系統(tǒng)中。
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適用于SmartFusion智能混合信號(hào)FPGA的功率管理解決方案（Actel）
愛(ài)特公司(Actel Corporation)發(fā)布適用于其新近推出的SmartFusion™智能混合信號(hào) FPGA的功率管理解決方案。Actel混合信號(hào)功率管理工具(Mixed Signal Power Manager, MPM)解決方案包括帶有圖形配置器以輸入功率管
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基于FPGA的DDR內(nèi)存條的控制
摘要：隨著數(shù)據(jù)存儲(chǔ)量的日益加大以及存儲(chǔ)速度的加快，大容量的高速存儲(chǔ)變得越來(lái)越重要。內(nèi)存條既能滿足大容量的存儲(chǔ)又能滿足讀寫(xiě)速度快的要求，這樣使得對(duì)內(nèi)存條控制的應(yīng)用越來(lái)越廣泛。首先介紹了內(nèi)存條的工作原
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基于FPGA的多路視頻通道控制
根據(jù)織布機(jī)告警系統(tǒng)的需求，提出一種開(kāi)關(guān)設(shè)計(jì)思想，闡述開(kāi)關(guān)設(shè)計(jì)過(guò)程中遇到的問(wèn)題以及解決方法。首先在FPGA中設(shè)計(jì)一個(gè)開(kāi)關(guān)控制信號(hào)，利用這個(gè)信號(hào)結(jié)合雙口RAM中的編碼數(shù)據(jù)識(shí)別兩個(gè)撥動(dòng)開(kāi)關(guān)狀態(tài)，從而達(dá)到控制多路視頻通道的目的，使本告警系統(tǒng)更方便的應(yīng)用于實(shí)際工業(yè)中。介紹整個(gè)控制系統(tǒng)的工作原理，給出硬件結(jié)構(gòu)圖和軟件設(shè)計(jì)過(guò)程，然后利用QuartusⅡ中的SignalTapⅡLogic Analyzer工具對(duì)控制信號(hào)進(jìn)行實(shí)時(shí)采樣分析，最后在織布機(jī)告警系統(tǒng)中成功實(shí)現(xiàn)視頻通道控制功能。
