FPGA
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基于FPGA的IEEE-1394b雙向數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
基于FPGA的IEEE-1394b雙向數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
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基于FPGA的語音端點(diǎn)檢測
語音端點(diǎn)檢測就是從背景噪聲中找到語音的起點(diǎn)和終點(diǎn)，其目標(biāo)是要在一段輸入信號中將語音信號同其他信號(如背景噪聲)分離并且準(zhǔn)確地判斷出語音的端點(diǎn)。研究表明，即使在安靜的環(huán)境中，一半以上的語音識別系統(tǒng)識別錯誤
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基于FPGA的語音端點(diǎn)檢測
基于FPGA的語音端點(diǎn)檢測
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基于FPGA的AD9910控制設(shè)計(jì)
為了滿足目前對數(shù)據(jù)處理速度的需求，設(shè)計(jì)了一種基于FPGA+DDS的控制系統(tǒng)。根據(jù)AD9910的特點(diǎn)設(shè)計(jì)了控制系統(tǒng)的硬件部分，詳細(xì)闡述了電源、地和濾波器的設(shè)計(jì)。設(shè)計(jì)了FPGA的軟件控制流程，給出了流程圖和關(guān)鍵部分的例程，并對DDS AD9910各個控制寄存器的設(shè)置與時(shí)序進(jìn)行詳細(xì)說明，最后給出了實(shí)驗(yàn)結(jié)果。實(shí)驗(yàn)結(jié)果證明輸出波形質(zhì)量高、效果好。對于頻率源的設(shè)計(jì)與實(shí)現(xiàn)具有工程實(shí)踐意義。
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基于FPGA的高速數(shù)據(jù)處理系統(tǒng)設(shè)計(jì)
針對光纖微擾動傳感器的高速數(shù)據(jù)處理問題，設(shè)計(jì)一種以XC4VSX25為核心，具有數(shù)據(jù)采集功能、存儲功能、LCD顯示功能和USB通信功能的系統(tǒng)。利用XC4VSX25帶有的XtremeDSP IP核，通過并行運(yùn)算解決高速實(shí)時(shí)數(shù)據(jù)處理問題，并且通過Verilog HDL語言設(shè)計(jì)串行結(jié)構(gòu)和并行結(jié)構(gòu)，并在ModelSim中對兩種結(jié)構(gòu)進(jìn)行仿真比較。結(jié)果表明，本系統(tǒng)中并型結(jié)構(gòu)的計(jì)算速度是正比于并行度的，可以提高系統(tǒng)處理速度。
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基于FPGA的高速數(shù)據(jù)處理系統(tǒng)設(shè)計(jì)
針對光纖微擾動傳感器的高速數(shù)據(jù)處理問題，設(shè)計(jì)一種以XC4VSX25為核心，具有數(shù)據(jù)采集功能、存儲功能、LCD顯示功能和USB通信功能的系統(tǒng)。利用XC4VSX25帶有的XtremeDSP IP核，通過并行運(yùn)算解決高速實(shí)時(shí)數(shù)據(jù)處理問題，并且通過Verilog HDL語言設(shè)計(jì)串行結(jié)構(gòu)和并行結(jié)構(gòu)，并在ModelSim中對兩種結(jié)構(gòu)進(jìn)行仿真比較。結(jié)果表明，本系統(tǒng)中并型結(jié)構(gòu)的計(jì)算速度是正比于并行度的，可以提高系統(tǒng)處理速度。
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大規(guī)?，F(xiàn)場可編程門陣列（FPGA）開發(fā)系統(tǒng)電源設(shè)計(jì)研究
摘要：以Xilinx的FPGA為例，介紹了FPGA開發(fā)系統(tǒng)的電源要求和功耗，并給出了采用線性低壓降（LDO）穩(wěn)壓器,DC/DC調(diào)整器,DC/DC控制器和電源模塊等幾種電源解決方案。 關(guān)鍵詞：現(xiàn)場可編程門陣列；電源設(shè)計(jì)；DC/DC變換器
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大規(guī)模現(xiàn)場可編程門陣列（FPGA）開發(fā)系統(tǒng)電源設(shè)計(jì)研究
摘要：以Xilinx的FPGA為例，介紹了FPGA開發(fā)系統(tǒng)的電源要求和功耗，并給出了采用線性低壓降（LDO）穩(wěn)壓器,DC/DC調(diào)整器,DC/DC控制器和電源模塊等幾種電源解決方案。 關(guān)鍵詞：現(xiàn)場可編程門陣列；電源設(shè)計(jì)；DC/DC變換器
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大規(guī)模現(xiàn)場可編程門陣列（FPGA）開發(fā)系統(tǒng)電源設(shè)計(jì)研究
摘要：以Xilinx的FPGA為例，介紹了FPGA開發(fā)系統(tǒng)的電源要求和功耗，并給出了采用線性低壓降（LDO）穩(wěn)壓器,DC/DC調(diào)整器,DC/DC控制器和電源模塊等幾種電源解決方案。 關(guān)鍵詞：現(xiàn)場可編程門陣列；電源設(shè)計(jì)；DC/DC變換器
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一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
隨著嵌入式技術(shù)的飛速發(fā)展，對嵌入式系統(tǒng)的應(yīng)用需求也呈現(xiàn)出不斷增長的態(tài)勢，因此，嵌入式技術(shù)也相應(yīng)地取得了重要的進(jìn)展，系統(tǒng)設(shè)備不斷向高速化、集成化、低功耗的方向發(fā)展?，F(xiàn)場可編程門陣列FPGA經(jīng)過近20年的發(fā)展，
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基于FPGA的CMI編碼系統(tǒng)設(shè)計(jì)
摘要：提出了一種基于FPGA并利用Verilog HDL實(shí)現(xiàn)的CMI編碼設(shè)計(jì)方法。研究了CMI碼型的編碼特點(diǎn)，提出了利用Altera公司CycloneⅡ系列EP2C5Q型號FPGA完成CMI編碼功能的方案。在系統(tǒng)程序設(shè)計(jì)中，首先產(chǎn)生m序列，然后程序
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基于FPGA的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
摘要：基于FPGA和USB2．0的技術(shù)方案，設(shè)計(jì)了一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)是以Altera公司的FPGA芯片EP2C5T144為主控芯片，以Cypress公司的EZ-USB FX2芯片為傳輸手段設(shè)計(jì)實(shí)現(xiàn)的。首先詳細(xì)介紹了整體系統(tǒng)的
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基于FPGA+DSP的雷達(dá)高速數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)
摘要：激光雷達(dá)的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點(diǎn)，對其進(jìn)行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時(shí)，A/D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導(dǎo)致數(shù)據(jù)傳輸不
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基于FPGA與DSP的雷達(dá)高速數(shù)據(jù)采集系統(tǒng)
激光雷達(dá)的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點(diǎn)，對其進(jìn)行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時(shí)，A／D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導(dǎo)致數(shù)據(jù)傳輸不及時(shí)，影響系統(tǒng)可靠性、實(shí)時(shí)性。針對激光雷達(dá)回?fù)苄盘?，提出基于FPGA與DSP的高速數(shù)據(jù)采集系統(tǒng)，利用FPGA內(nèi)部的異步FIFO和DCM實(shí)現(xiàn)A／D轉(zhuǎn)換器與DSP的高速外部存儲接口(EMIF)之間的數(shù)據(jù)傳輸。介紹了ADC外圍電路、工作時(shí)序以及DSP的EMIF的設(shè)置參數(shù)，并對異步FIFO數(shù)據(jù)讀寫進(jìn)行仿真，結(jié)合硬件結(jié)構(gòu)詳細(xì)地分析設(shè)計(jì)應(yīng)注意的問 題。系統(tǒng)采樣率為30MHz，采樣精度為12位。
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一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
隨著嵌入式技術(shù)的飛速發(fā)展，對嵌入式系統(tǒng)的應(yīng)用需求也呈現(xiàn)出不斷增長的態(tài)勢，因此，嵌入式技術(shù)也相應(yīng)地取得了重要的進(jìn)展，系統(tǒng)設(shè)備不斷向高速化、集成化、低功耗的方向發(fā)展?，F(xiàn)場可編程門陣列FPGA經(jīng)過近20年的發(fā)展，
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基于FPGA的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
摘要：基于FPGA和USB2．0的技術(shù)方案，設(shè)計(jì)了一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)是以Altera公司的FPGA芯片EP2C5T144為主控芯片，以Cypress公司的EZ-USB FX2芯片為傳輸手段設(shè)計(jì)實(shí)現(xiàn)的。首先詳細(xì)介紹了整體系統(tǒng)的
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一種基于FPGA 的嵌入式塊SRAM 的設(shè)計(jì)
摘 要：文章中提出了一種應(yīng)用于FPGA 的嵌入式可配置雙端口的塊存儲器。該存儲器包括與其他電路的布線接口、可配置邏輯、可配置譯碼、高速讀寫電路。在編程狀態(tài)下，可對所有存儲單元進(jìn)行清零，且編程后為兩端口獨(dú)
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基于FPGA的語音存儲與回放系統(tǒng)設(shè)計(jì)
1 設(shè)計(jì)要求 設(shè)計(jì)并制作一個數(shù)字化語音存儲與回放系統(tǒng)，其示意圖如圖1所示。 圖1 數(shù)字化語音存儲與回放系統(tǒng)示意圖 (1)放大器1的增益為46dB，放大器2的增益為40dB，增益均可調(diào)； (2)帶通濾波器：通帶為30
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基于FPGA 與VHDL 的微型打印機(jī)的驅(qū)動設(shè)計(jì)
摘 要：為了取代傳統(tǒng)利用單片機(jī)驅(qū)動微型打印機(jī)，使用Alt era 公司的FPGA 芯片EP3C25Q240C8N 設(shè)計(jì)驅(qū)動打印機(jī)的硬件控制電路，并正確控制微型打印機(jī)的工作時(shí)序。軟件使用硬件描述語言VH DL 實(shí)現(xiàn)對微型打印機(jī)的時(shí)序控
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基于FPGA 的衛(wèi)星便攜站的同步數(shù)字復(fù)接器的設(shè)計(jì)
在便攜式數(shù)字衛(wèi)星通信系統(tǒng)中，為了擴(kuò)大傳輸容量和提高傳輸效率，滿足同時(shí)傳輸幾種業(yè)務(wù)的需求，通常采用時(shí)分復(fù)用的方法，將若干個低速數(shù)字碼流按一定格式合并成一個高速數(shù)據(jù)碼流，以便在一條信道中傳輸，使各個業(yè)務(wù)信
