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WCDMA系統(tǒng)基帶處理的DSP FPGA實現(xiàn)方案
引言隨著Internet的迅猛發(fā)展和各種無線業(yè)務需求的增加，目前以承載單一話音業(yè)務為主的無線通信網(wǎng)已經(jīng)越來越不適應人們的需要，所以，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務為目的的第三代移動通信系統(tǒng)(IMT-2000)成為無
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基于FPGA實現(xiàn)固定倍率的圖像縮放
摘要：基于FPGA硬件實現(xiàn)固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進行行方向的卷積，再進行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過程設計為一個單元體的循環(huán)過程，在
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基于FPGA實現(xiàn)低成本、小體積PET系統(tǒng)
隨著醫(yī)療成像系統(tǒng)不斷追求更高的性能，傳統(tǒng)的模擬及分立器件越來越難以滿足系統(tǒng)設計的要求，而采用數(shù)字信號處理技術(shù)DSP、FPGA已成為了必然的選擇。好處顯然易見，無論是從系統(tǒng)的集成度還是成本、性能上來看，都給設計
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LED顯示屏高灰度掃描控制的FPGA實現(xiàn)
摘要：本文在分析LED顯示屏的顯示掃描控制方法的基礎上，提出了用并行結(jié)構(gòu)實現(xiàn)高灰度掃描控制的方案，設計了基于FPGA的8位并行輸入LED掃描控制芯片，并結(jié)合外圍電路、顯示面板及計算機構(gòu)成了LED大屏幕顯示系統(tǒng)，實現(xiàn)
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基于FPGA實現(xiàn)低成本、小體積PET系統(tǒng)
隨著醫(yī)療成像系統(tǒng)不斷追求更高的性能，傳統(tǒng)的模擬及分立器件越來越難以滿足系統(tǒng)設計的要求，而采用數(shù)字信號處理技術(shù)DSP、FPGA已成為了必然的選擇。好處顯然易見，無論是從系統(tǒng)的集成度還是成本、性能上來看，都給設計
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LED顯示屏高灰度掃描控制的FPGA實現(xiàn)
摘要：本文在分析LED顯示屏的顯示掃描控制方法的基礎上，提出了用并行結(jié)構(gòu)實現(xiàn)高灰度掃描控制的方案，設計了基于FPGA的8位并行輸入LED掃描控制芯片，并結(jié)合外圍電路、顯示面板及計算機構(gòu)成了LED大屏幕顯示系統(tǒng)，實現(xiàn)
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高性能維特比在衛(wèi)星導航接收機中FPGA實現(xiàn)
摘要：衛(wèi)星定位接收機中卷積碼譯碼即維特比譯碼器，在處理器中面臨占有資源較多、處理時間過長等問題，為了減少處理器資源的占用和提高處理速度，采用并行加比選蝶形單元的的方法，在FPGA平臺上用硬件描述語言設計一
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HDLC的FPGA實現(xiàn)方法
1 引言 HDLC（High-level Data Link Control Procedures, 高級數(shù)據(jù)鏈路控制規(guī)程）廣泛應用于數(shù)據(jù)通信領域，是確保數(shù)據(jù)信息可靠互通的重要技術(shù)。實施HDLC的一般方法通常是采用ASIC（Application Specific Integr
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用FPGA實現(xiàn)WCDMA下行擾碼
1 概述在WCDMA中，加擾就是用一個偽隨機碼序列對擴頻碼進行相乘，對信號進行加密。上行鏈路物理信道加擾的作用是區(qū)分用戶，下行鏈路加擾可以區(qū)分小區(qū)和信道。WCDMA采用Gold碼作為擴頻序列的擾碼。Gold由兩個M序列相
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基于FPGA實現(xiàn)千兆以太網(wǎng)業(yè)務在SDH上的傳輸
摘要：為了實現(xiàn)千兆以太網(wǎng)業(yè)務在SDH網(wǎng)絡上的傳輸(EOS)，可以利用FPGA將以太網(wǎng)MAC數(shù)據(jù)幀在SDH數(shù)據(jù)幀中進行封裝和映射處理。介紹了GFP封裝協(xié)議以及虛級聯(lián)技術(shù)，給出了FPGA內(nèi)部的模塊化設計方法。利用FPGA的強大功能和內(nèi)
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基于PN序列幀的同步分析及FPGA實現(xiàn)
摘要：闡述了一種導頻疊加的OFDM同步方法，利用具有良好的自相關性PN序列實現(xiàn)時偏和頻偏估計。在多徑信道條件下，通過Matlab仿真能較好地實現(xiàn)同步。然后利用Altera公司的芯片在QuartusⅡ8．0工具平臺上實現(xiàn)了OFDM同步
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基于PN序列幀的同步分析及FPGA實現(xiàn)
摘要：闡述了一種導頻疊加的OFDM同步方法，利用具有良好的自相關性PN序列實現(xiàn)時偏和頻偏估計。在多徑信道條件下，通過Matlab仿真能較好地實現(xiàn)同步。然后利用Altera公司的芯片在QuartusⅡ8．0工具平臺上實現(xiàn)了OFDM同步
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利用FPGA實現(xiàn)與DS18B20的通信功能
DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測溫分辨率可達0.0625℃，被測溫度用符號擴展的16位數(shù)字量方式串行輸出
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YUV分離的兩種FPGA實現(xiàn)
摘要：速度與面積的互換一直是基于FPGA設計中的一個不變的主題，在此介紹了兩種YUV分離的FPGA的實現(xiàn)方式：基于面積的實現(xiàn)和基于速度的實現(xiàn)。前者僅用一片雙口RAM串行，實現(xiàn)了YUV分離數(shù)據(jù)的輸出；后者利用流水線的思想
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混合信號FPGA實現(xiàn)真正單芯片SOC
要實現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產(chǎn)權(quán)的保護。如果
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GPIB接口的FPGA實現(xiàn)
摘 要：GPIB接口是測試儀器中常用的接口方式。通過將接口設計分解為同步狀態(tài)機設計和寄存器讀寫電路設計，采用Verilog語言實現(xiàn)了滿足IEEE488.1協(xié)議的IP Core設計。將此IP Core固化到FPGA芯片中即可實現(xiàn)GPIB各種接
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用FPGA實現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)
用FPGA實現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)
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用FPGA實現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)
用FPGA實現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)
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FPGA實現(xiàn)多處理器解決方案
尋求高性能處理能力的嵌入式設計人員在成本、性能、功耗上,不可避免的面臨類似“百慕大三角”的困境,無法同時實現(xiàn)三者的最佳組合,而只能達到其中的兩個目標。定制ASIC設計適用于那些能夠負擔得起時間、費用
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FPGA實現(xiàn)多處理器解決方案
FPGA實現(xiàn)多處理器解決方案
