26年前賽靈思發(fā)明了可編程邏輯器件,現(xiàn)在,賽靈思的產(chǎn)品已經(jīng)遍布無(wú)線基礎(chǔ)設(shè)施當(dāng)中,特別是在國(guó)內(nèi)TD-SCDMA的部署中,無(wú)處不在。FPGA的一個(gè)重要價(jià)值在于為運(yùn)營(yíng)商快速將產(chǎn)品推向市場(chǎng)提供了時(shí)間保證,并且FPGA的可編程性
全球可編程平臺(tái)領(lǐng)導(dǎo)廠商美商賽靈思(Xilinx)(XLNX-US)今日宣布發(fā)表業(yè)界首創(chuàng)的堆棧式硅晶互連技術(shù),帶來(lái)突破性的容量、帶寬、以及省電性,將多個(gè)可編程邏輯芯片(FPG)晶粒整合到一個(gè)封裝,以滿足各種需要大量晶體管與
無(wú)線收發(fā)模塊是RFID無(wú)線通信系統(tǒng)的關(guān)鍵。研究并實(shí)現(xiàn)了基于FPGA的RFID無(wú)線通信系統(tǒng),該系統(tǒng)采用NRF905和XC2V1000芯片分別作為RFID無(wú)線收發(fā)模塊和FPGA控制模塊。利用基于Wishbone總線控制的SPI控制模塊完成了XC2V1000和NRF905之間的SPI總線模式通信設(shè)計(jì)。由于采用了參數(shù)化設(shè)計(jì),提高了其通用性和靈活性。設(shè)計(jì)通過(guò)了前仿真與布局后仿真,并在板級(jí)驗(yàn)證中實(shí)現(xiàn)了系統(tǒng)100 m距離通信。
賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品,不僅使FPGA市場(chǎng)戰(zhàn)火升溫,也讓晶圓代工市場(chǎng)激烈角逐,在Xilinx首度與臺(tái)積電攜手合作后,Altera在28納米產(chǎn)品的布局上亦相當(dāng)積極,近期亦展示在28納米FPGA平
全硅MEMS時(shí)脈技術(shù)方案公司SiTIme Corporation宣布賽靈思(Xilinx)在其Virtex-6 FPGA ML605評(píng)估套件, Spartan-6 FPGA SP601 和SP605 FPGA評(píng)估套件上導(dǎo)入了SiTime可編程全硅MEMS振蕩器。全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思
關(guān)鍵字: FPGA ARM DSP CPU “我們已經(jīng)連續(xù)三個(gè)季度銷售額創(chuàng)新高了,今年Q2我們的銷售
研華選擇Actel的ProASICPLUS APA450和ProASIC3 A3P060 FPGA,做為其網(wǎng)絡(luò)平臺(tái)來(lái)進(jìn)行系統(tǒng)總線控制和開(kāi)機(jī)程序功能。在成功運(yùn)行其網(wǎng)絡(luò)平臺(tái)設(shè)計(jì)之后,研華再次尋求Actel為其新的游戲平臺(tái)提供FPGA解決方案。對(duì)于這個(gè)專案
2010年9月15,美國(guó)加洲森尼韋爾市-全硅MEMS時(shí)脈技術(shù)方案領(lǐng)導(dǎo)公司SiTime Corporation今天宣布賽靈思(Xilinx)在其Virtex?-6 FPGA ML605評(píng)估套件, Spartan?-6 FPGA SP601 和SP605 FPGA評(píng)估套件上導(dǎo)入了SiTime可編程全硅
Altera拓展工業(yè)網(wǎng)絡(luò)合作伙伴計(jì)劃,增加了IP及Terasic具有Altera Cyclone IV E FPGA的工業(yè)網(wǎng)絡(luò)套件 為幫助工業(yè)網(wǎng)絡(luò)設(shè)計(jì)人員縮短開(kāi)發(fā)時(shí)間,Altera公司 (NASDAQ: ALTR)今天宣布,拓展其工業(yè)網(wǎng)絡(luò)合作伙伴計(jì)劃 (INPP),包
愛(ài)特公司(Actel Corporation)今天宣布該公司的ProASICPLUS ®和ProASIC ®3 FPGA,已由研華科技采用于其網(wǎng)絡(luò)和游戲平臺(tái)。總部位于臺(tái)灣的研華科技,透過(guò)其值得信賴的ePlatform服務(wù),提供電子世界中計(jì)算和基于網(wǎng)
FPGA在廣播視頻處理中的應(yīng)用
設(shè)計(jì)了FPGA的分布式算法結(jié)構(gòu)和具體的硬件環(huán)境?;贔PGA的分布式算法充分利用FPGA的并行處理特性設(shè)計(jì)算法,簡(jiǎn)化了濾波器系統(tǒng)設(shè)計(jì)。采用了分割查找表技術(shù),節(jié)省了FPGA硬件資源。對(duì)查找表(LUT)中內(nèi)容經(jīng)過(guò)相應(yīng)的修改即可方便地實(shí)現(xiàn)低通、高通、帶通濾波。對(duì)基于FPGA分布式算法的濾波器進(jìn)行了仿真及工況環(huán)境下的測(cè)試實(shí)驗(yàn)。實(shí)驗(yàn)結(jié)果表明,該算法不僅提高了系統(tǒng)運(yùn)行速度,而且節(jié)省了大量的FPGA資源,還具有極大的靈活性。
為幫助工業(yè)網(wǎng)絡(luò)設(shè)計(jì)人員縮短開(kāi)發(fā)時(shí)間,Altera公司日前宣布,拓展其工業(yè)網(wǎng)絡(luò)合作伙伴計(jì)劃 (INPP),包括由Terasic提供的工業(yè)網(wǎng)絡(luò)新套件(INK)。通過(guò)方便的在線網(wǎng)站altera.com.cn ,設(shè)計(jì)人員現(xiàn)在可同時(shí)使用套件和Altera合
系統(tǒng)用FPGA實(shí)現(xiàn)了I2C總線控制器,以Altera公司的NiosⅡ嵌入式軟處理器為核心,結(jié)合高品質(zhì)數(shù)字信號(hào)音頻編/解碼芯片WM8731成功地實(shí)現(xiàn)了語(yǔ)音的錄制及回放功能,同時(shí)利用Matlab 7.O.4軟件對(duì)所采集的語(yǔ)音數(shù)據(jù)進(jìn)行仿真。系統(tǒng)采用SoPC技術(shù),自行設(shè)計(jì)采集模塊和I2C協(xié)議驅(qū)動(dòng)模塊,并通過(guò)AWALON總線掛裁在Nios軟核上實(shí)時(shí)高速采集與回放。實(shí)踐表明,系統(tǒng)具有集成度高,穩(wěn)定性好,實(shí)時(shí)性強(qiáng)的特點(diǎn)。
為了方便外部設(shè)備與計(jì)算機(jī)進(jìn)行串口通信,提出一種基于FPGA的PCI總線串口卡設(shè)計(jì)。利用Altera公司的FPGA芯片EP1C6SQ240實(shí)現(xiàn)了串口和PCI總線的連接。介紹了用FPGA實(shí)現(xiàn)PCI接口、UART的方法,將PCI接口、UART的核心功能集中在FPGA上,使整個(gè)設(shè)計(jì)緊湊、小巧。該設(shè)計(jì)符合PCI 2.2規(guī)范,傳輸速率高,可廣泛應(yīng)用于各類測(cè)試設(shè)備、工廠自動(dòng)化、有線通信等領(lǐng)域。
設(shè)計(jì)了FPGA的分布式算法結(jié)構(gòu)和具體的硬件環(huán)境。基于FPGA的分布式算法充分利用FPGA的并行處理特性設(shè)計(jì)算法,簡(jiǎn)化了濾波器系統(tǒng)設(shè)計(jì)。采用了分割查找表技術(shù),節(jié)省了FPGA硬件資源。對(duì)查找表(LUT)中內(nèi)容經(jīng)過(guò)相應(yīng)的修改即可方便地實(shí)現(xiàn)低通、高通、帶通濾波。對(duì)基于FPGA分布式算法的濾波器進(jìn)行了仿真及工況環(huán)境下的測(cè)試實(shí)驗(yàn)。實(shí)驗(yàn)結(jié)果表明,該算法不僅提高了系統(tǒng)運(yùn)行速度,而且節(jié)省了大量的FPGA資源,還具有極大的靈活性。
為幫助工業(yè)網(wǎng)絡(luò)設(shè)計(jì)人員縮短開(kāi)發(fā)時(shí)間,Altera公司日前宣布,拓展其工業(yè)網(wǎng)絡(luò)合作伙伴計(jì)劃 (INPP),包括由Terasic提供的工業(yè)網(wǎng)絡(luò)新套件(INK)。通過(guò)方便的在線網(wǎng)站altera.com.cn ,設(shè)計(jì)人員現(xiàn)在可同時(shí)使用套件和Altera合
系統(tǒng)用FPGA實(shí)現(xiàn)了I2C總線控制器,以Altera公司的NiosⅡ嵌入式軟處理器為核心,結(jié)合高品質(zhì)數(shù)字信號(hào)音頻編/解碼芯片WM8731成功地實(shí)現(xiàn)了語(yǔ)音的錄制及回放功能,同時(shí)利用Matlab 7.O.4軟件對(duì)所采集的語(yǔ)音數(shù)據(jù)進(jìn)行仿真。系統(tǒng)采用SoPC技術(shù),自行設(shè)計(jì)采集模塊和I2C協(xié)議驅(qū)動(dòng)模塊,并通過(guò)AWALON總線掛裁在Nios軟核上實(shí)時(shí)高速采集與回放。實(shí)踐表明,系統(tǒng)具有集成度高,穩(wěn)定性好,實(shí)時(shí)性強(qiáng)的特點(diǎn)。
基于FPGA的語(yǔ)音錄制與回放系統(tǒng)
基于DSP與FPGA的藍(lán)牙數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)