FPGA
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基于FPGA的數(shù)據(jù)采集控制模塊設(shè)計
0 引 言 數(shù)據(jù)采集和控制系統(tǒng)是對生產(chǎn)過程或科學(xué)實驗中各種物理量進(jìn)行實時采集、測試和反饋控制的閉環(huán)控制，它在工業(yè)控制、軍事電子設(shè)備、醫(yī)學(xué)監(jiān)護(hù)等許多領(lǐng)域發(fā)揮著重要作用。其中，數(shù)據(jù)采集部分尤為重要，而傳統(tǒng)
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基于FPGA的PCI接口控制器的設(shè)計與實現(xiàn)
pci總線是高速同步總線,采用高度綜合優(yōu)化的總線結(jié)構(gòu),目前廣泛應(yīng)用于各種計算機(jī)系統(tǒng)中,總線以32位（或64位）數(shù)據(jù)總線、33mhz（或66mhz）的時鐘頻率操作,具有很高的數(shù)據(jù)傳輸速率。 目前開發(fā)pci接口大體有兩種方案,一
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基于FPGA的級聯(lián)結(jié)構(gòu)FFT處理器的優(yōu)化設(shè)計
0 引 言 數(shù)字信號處理主要研究采用數(shù)字序列或符號序列表示信號，并用數(shù)字計算方法對這些序列進(jìn)行處理，以便把信號變換成符合某種需要的形式。在現(xiàn)代數(shù)字信號處理中，最常用的變換方法就是離散傅里葉變換(DFT)，
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運(yùn)動控制和混合信號FPGA
隨著電子元件的性能和集成度不斷提高而價格卻不斷降低，電子控制單元的發(fā)展正一日千里。隨著各種技術(shù)和應(yīng)用大量涌現(xiàn)，從家電領(lǐng)域到工業(yè)自動化生產(chǎn)線，大家關(guān)注的重點還是在增加設(shè)計和提高電源效率的同時能減少設(shè)
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基于FPGA的多種分頻設(shè)計與實現(xiàn)
0 引言分頻器是FPGA設(shè)計中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來進(jìn)行時鐘的分頻、倍頻以及相移設(shè)計，但是，對于時鐘要求不太嚴(yán)格的設(shè)計，通過自
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通過USB接口實現(xiàn)FPGA的SelectMap配置
1.引言 FPGA器件結(jié)合了 ASIC的高性能和微處理器的靈活，不僅擁有豐富的邏輯資源，而且可以進(jìn)行方便靈活的配置。主動配置方式盡管配置速度快、實現(xiàn)簡單，但并未發(fā)揮 FPGA配置靈活的特點，適合于 FPGA用作單一應(yīng)用的場
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基于FPGA的數(shù)據(jù)采集控制模塊設(shè)計
0 引 言 數(shù)據(jù)采集和控制系統(tǒng)是對生產(chǎn)過程或科學(xué)實驗中各種物理量進(jìn)行實時采集、測試和反饋控制的閉環(huán)控制，它在工業(yè)控制、軍事電子設(shè)備、醫(yī)學(xué)監(jiān)護(hù)等許多領(lǐng)域發(fā)揮著重要作用。其中，數(shù)據(jù)采集部分尤為重要，而傳統(tǒng)
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基于AMBA總線的智能卡控制器設(shè)計
摘要：通過分析ISO/IEC 7816-3傳輸協(xié)議,設(shè)計該符合協(xié)議標(biāo)準(zhǔn)的接觸式智能卡控制器,實現(xiàn)對字符傳輸和塊傳輸這兩種不同傳輸方式的智能卡的支持。該控制器集成于基于AMBA總線的Garfield系列芯片SEP4020中,采用硬件描述
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PCB 專業(yè)人員何去何從?
沒什么能比具有爭議性的問題更能激發(fā)各種觀點和討論。 了解電路板布線專業(yè)人員的未來本身就是一個重要的問題，但如果是暗示這些設(shè)計工程師需要“繼續(xù)前進(jìn)”，則是另外一回事。這其實是指一個正在收縮的設(shè)計領(lǐng)域
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基于FPGA的級聯(lián)結(jié)構(gòu)FFT處理器的優(yōu)化設(shè)計
0 引 言 數(shù)字信號處理主要研究采用數(shù)字序列或符號序列表示信號，并用數(shù)字計算方法對這些序列進(jìn)行處理，以便把信號變換成符合某種需要的形式。在現(xiàn)代數(shù)字信號處理中，最常用的變換方法就是離散傅里葉變換(DFT)，
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基于FPGA的溫度模糊自適應(yīng)PID控制器的設(shè)計
針對某恒溫箱控制系統(tǒng)中存在的非線性、時變等特點，結(jié)合傳統(tǒng)PID與現(xiàn)代模糊控制理論，以EP1C12型FP-GA為核心控制器，采用模塊化思想，設(shè)計并實現(xiàn)溫度模糊自適應(yīng)PID控制。實際運(yùn)行結(jié)果表明，采用該方法可明顯改善控制效果，在簡化設(shè)計的同時，也可提高系統(tǒng)的運(yùn)算速度和可靠性。
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基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設(shè)計
設(shè)計基于FPGA的8段數(shù)碼管動態(tài)顯示IP核，介紹8段數(shù)碼管內(nèi)部結(jié)構(gòu)及其驅(qū)動顯示方式和IP核設(shè)計方法，給出8段數(shù)碼管動態(tài)顯示IP核的Verilog HDL程序源代碼及其C語言驅(qū)動程序。此IP核可例化成1～8個共陰極(或共陽極)數(shù)碼管控制器，能方便地控制1～8個數(shù)碼管同時顯示數(shù)字和小數(shù)點位。測試結(jié)果表明，該IP核工作可靠、穩(wěn)定，可直接應(yīng)用于電子設(shè)計中。
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運(yùn)動控制和混合信號FPGA
隨著電子元件的性能和集成度不斷提高而價格卻不斷降低，電子控制單元的發(fā)展正一日千里。隨著各種技術(shù)和應(yīng)用大量涌現(xiàn)，從家電領(lǐng)域到工業(yè)自動化生產(chǎn)線，大家關(guān)注的重點還是在增加設(shè)計和提高電源效率的同時能減少設(shè)
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一種基于DSP+FPGA的控制系統(tǒng)方案設(shè)計
一、前言 ? 本文提到的控制系統(tǒng)控制通信設(shè)備的正常工作，是整個通信設(shè)備的重要組成部分。該控制系統(tǒng)要實現(xiàn)的功能為: 接收外來的信息、實時采集輸入的信號,控制設(shè)備的工作狀態(tài)、參數(shù)、頻率、電壓及完成設(shè)備的故
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一種基于DSP+FPGA的控制系統(tǒng)方案設(shè)計
一種基于DSP+FPGA的控制系統(tǒng)方案設(shè)計
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基于FPGA的溫度模糊自適應(yīng)PID控制器的設(shè)計
基于FPGA的溫度模糊自適應(yīng)PID控制器的設(shè)計
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基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設(shè)計
設(shè)計基于FPGA的8段數(shù)碼管動態(tài)顯示IP核，介紹8段數(shù)碼管內(nèi)部結(jié)構(gòu)及其驅(qū)動顯示方式和IP核設(shè)計方法，給出8段數(shù)碼管動態(tài)顯示IP核的Verilog HDL程序源代碼及其C語言驅(qū)動程序。此IP核可例化成1～8個共陰極(或共陽極)數(shù)碼管控制器，能方便地控制1～8個數(shù)碼管同時顯示數(shù)字和小數(shù)點位。測試結(jié)果表明，該IP核工作可靠、穩(wěn)定，可直接應(yīng)用于電子設(shè)計中。
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基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設(shè)計
基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設(shè)計
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基于FPGA“乒乓球比賽游戲機(jī)”的設(shè)計
可編程邏輯器件FPGA以其開發(fā)周期短、成本低、功耗低、可靠性高等優(yōu)勢，廣泛應(yīng)用于通信、航空、醫(yī)療等領(lǐng)域，近年來在消費(fèi)電子領(lǐng)域中的應(yīng)用也日漸增加。為進(jìn)一步挖掘FPGA在家庭娛樂如游戲機(jī)開發(fā)與應(yīng)用中的巨大商
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基于FPGA的AGWN信號生成器
在通信系統(tǒng)中分析計算系統(tǒng)抗噪聲性能時，經(jīng)常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過分析AGWN的性質(zhì)，采用自頂向下的設(shè)計思路，將AGWN信號分成若干模塊，最終使用Verilog硬件描述語言，完成了通信
