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摘 要: 針對1000BASE-T中的均衡解碼結(jié)構(gòu),從信噪比與誤碼率、速度及硬件復雜度等方面比較了該判決反饋均衡解碼器的幾種形式,并設計了一種滿足速度與誤碼率要求而硬件復雜度更低的混合型結(jié)構(gòu),該結(jié)構(gòu)將部分殘留后饋干擾級數(shù)移除,同時應用流水線及重定時技術優(yōu)化其性能。
關鍵詞: 判決反饋均衡;1000BASE-T;混合結(jié)構(gòu);網(wǎng)格譯碼

1 判決反饋均衡解碼器的結(jié)構(gòu)
 許多數(shù)字通信系統(tǒng)中都使用了網(wǎng)格編碼和脈沖幅度調(diào)制,1000BASE-T中使用4維8狀態(tài)網(wǎng)格編碼及5電平調(diào)制,每對雙絞線上有5種符號{-2,-1,0,1,2},分為A={-1,1},B={-2,0,2}兩組。4對雙絞線組合的16種結(jié)果分為圖1(a)所示的8個子集,屬于相同子集的不同符號間的歐氏距離為4。圖1(b)為其網(wǎng)格編碼[1]圖,每個狀態(tài)均有4條進出路徑,偶狀態(tài)ρ0、ρ2、ρ4、ρ6出發(fā)路徑對應的輸出判決符號取自偶子集S0、S2、S4、S6;奇狀態(tài)ρ1、ρ3、ρ5、ρ7出發(fā)路徑輸出判決符號取自奇子集S1、S3、S5、S7,相同起止點的編碼路徑間最小距離為4,即網(wǎng)格編碼在理想條件下可以獲取6 dB編碼增益。
 由于噪聲和串擾的存在,譯碼使用了基于最大似然估計(MLSE)的維特比算法,該算法的復雜度隨著信道數(shù)和譯碼深度呈指數(shù)增長,因此,硬件復雜度是算法設計重點。一種是串聯(lián)式均衡解碼器結(jié)構(gòu),即將4個DFE(判決反饋均衡器)與一個維特比譯碼器串聯(lián),如圖2所示。其中,4路DFE用于消除后饋干擾,維特比譯碼器則用于進行網(wǎng)格譯碼,兩部分組成串聯(lián)式結(jié)構(gòu)。

 串聯(lián)分離式結(jié)構(gòu)[2]電路簡單、硬件開銷小、可流水線操作且速度快。但其中DFE輸入直接來自硬判決,當存在誤判時,會引起錯誤傳遞[3],導致誤碼率升高。抑制誤差傳遞的一種方法是使用并聯(lián)式結(jié)構(gòu),如圖3所示。DFE與Viterbi譯碼器形成環(huán)路,后饋干擾補償嵌入Viterbi譯碼器中,DFU輸入不采用硬判決而采用各狀態(tài)幸存信號,這種結(jié)構(gòu)能取得很好的誤碼率性能。

 并聯(lián)式結(jié)構(gòu)針對8狀態(tài)都進行了DFU計算,需8倍的DFU單元數(shù)、8倍的1D-BMU單元數(shù)以及4倍的4D-BMU的單元數(shù),大大增加了硬件開銷。并且由于n時刻的碼間干擾計算需要此前的多級判決值,因此,后饋碼間干擾的補償、一維及4維分支度量計算、加比選單元以及幸存信號的選擇形成了一個關鍵回路,路徑延遲大,系統(tǒng)工作速率低。
串聯(lián)式結(jié)構(gòu)硬件簡單且能達到較高的速度,而并聯(lián)式結(jié)構(gòu)擁有較好的誤碼率性能,可以綜合這兩種結(jié)構(gòu)設計一種折衷的混合型結(jié)構(gòu)。
2 混合式結(jié)構(gòu)設計與實現(xiàn)

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