CPLD

我要報(bào)錯(cuò)

CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件，是從PAL和GAL器件發(fā)展出來(lái)的器件，相對(duì)而言規(guī)模大，結(jié)構(gòu)復(fù)雜，屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開發(fā)軟件平臺(tái)，用原理圖、硬件描述語(yǔ)言等方法，生成相應(yīng)的目標(biāo)文件，通過(guò)下載電纜（“在系統(tǒng)”編程）將代碼傳送到目標(biāo)芯片中，實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。

DM642和CPLD外部中斷的寄存器式鍵盤設(shè)計(jì)

摘要：介紹了一種采用DM642和CPLD相配合的擴(kuò)展鍵盤方法。CPLD管理鍵盤電路中的芯片邏輯，DM642的外部中斷監(jiān)控按鍵的狀態(tài)。簡(jiǎn)單闡述了鍵盤的分類，給出系統(tǒng)的硬件電路原理圖，在CCS軟件中調(diào)試程序方法。仿真結(jié)果表明，

數(shù)字電源
2011-08-16

寄存器 CPLD DM642 外部中斷
基于ARM和CPLD的嵌入式視覺系統(tǒng)設(shè)計(jì)

目前，關(guān)于視覺系統(tǒng)的研究已經(jīng)成為熱點(diǎn)，也有開發(fā)出的系統(tǒng)可供參考。但這些系統(tǒng)大多是基于PC機(jī)的，由于算法和硬件結(jié)構(gòu)的復(fù)雜性而使其在小型嵌入式系統(tǒng)中的應(yīng)用受到了限制。上述系統(tǒng)將圖像數(shù)據(jù)采集后，視覺處理算法是

數(shù)字電源
2011-08-16

ARM 系統(tǒng)設(shè)計(jì) 視覺系統(tǒng) CPLD
一款基于CPLD的LED顯示屏控制電路解決方案

本文著重介紹用M4A5-128P64-10VC設(shè)計(jì)LED顯示屏的控制電路。

數(shù)字電源
2011-08-16

計(jì)算機(jī) 控制電路 LED顯示屏 CPLD
基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計(jì)與實(shí)現(xiàn)

本文介紹了基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計(jì)流程，驗(yàn)證了利用現(xiàn)有IP Core設(shè)計(jì)的可行性和高效性。在設(shè)計(jì)過(guò)程中，硬件（實(shí)驗(yàn)評(píng)估板）的設(shè)計(jì)和基于IP Core的算法設(shè)計(jì)可同步進(jìn)行，避免了兩者因異步帶來(lái)的設(shè)計(jì)周期的延長(zhǎng)。實(shí)踐證明本文的設(shè)計(jì)思路和實(shí)現(xiàn)方法是一種靈活、快速、可靠地開發(fā)數(shù)字系統(tǒng)平臺(tái)的設(shè)計(jì)方案。

電源
2011-08-15

MP3 開發(fā)板 COOLRUNNER CPLD
基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

　本設(shè)計(jì)已經(jīng)完成了硬件及軟件的全部設(shè)計(jì)，讀取帶有絕對(duì)式編碼器的電動(dòng)機(jī)轉(zhuǎn)子的任何一個(gè)位置數(shù)據(jù)只需31μs，通信速率可達(dá)2.5Mb/s，將本設(shè)計(jì)集成在伺服驅(qū)動(dòng)單元中，驅(qū)動(dòng)和控制電動(dòng)機(jī)轉(zhuǎn)數(shù)可達(dá)6000轉(zhuǎn)/分，控制電動(dòng)機(jī)轉(zhuǎn)子的位置精度可達(dá)μM級(jí)。

電子設(shè)計(jì)自動(dòng)化
2011-08-11

高精度絕對(duì)式編碼器 BSP CPLD
基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

　本設(shè)計(jì)已經(jīng)完成了硬件及軟件的全部設(shè)計(jì)，讀取帶有絕對(duì)式編碼器的電動(dòng)機(jī)轉(zhuǎn)子的任何一個(gè)位置數(shù)據(jù)只需31μs，通信速率可達(dá)2.5Mb/s，將本設(shè)計(jì)集成在伺服驅(qū)動(dòng)單元中，驅(qū)動(dòng)和控制電動(dòng)機(jī)轉(zhuǎn)數(shù)可達(dá)6000轉(zhuǎn)/分，控制電動(dòng)機(jī)轉(zhuǎn)子的位置精度可達(dá)μM級(jí)。

電源
2011-08-09

高精度絕對(duì)式編碼器 BSP CPLD
基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

　本設(shè)計(jì)已經(jīng)完成了硬件及軟件的全部設(shè)計(jì)，讀取帶有絕對(duì)式編碼器的電動(dòng)機(jī)轉(zhuǎn)子的任何一個(gè)位置數(shù)據(jù)只需31μs，通信速率可達(dá)2.5Mb/s，將本設(shè)計(jì)集成在伺服驅(qū)動(dòng)單元中，驅(qū)動(dòng)和控制電動(dòng)機(jī)轉(zhuǎn)數(shù)可達(dá)6000轉(zhuǎn)/分，控制電動(dòng)機(jī)轉(zhuǎn)子的位置精度可達(dá)μM級(jí)。

數(shù)字電源
2011-08-09

高精度絕對(duì)式編碼器 BSP CPLD
基于CPLD的數(shù)字濾波抗干擾電路設(shè)計(jì)

　本文所給出的電路的主要功能是抗沖擊波和蚊蟲干擾，并把有效彈丸信號(hào)變成脈沖寬度為50μs的信號(hào)，然后輸出到下級(jí)電路進(jìn)行處理。設(shè)計(jì)中采用的芯片是MAX7000系列的EPM7128SLC84-15芯片。下面就如何實(shí)現(xiàn)濾波和抗干擾作以詳細(xì)介紹。

電子設(shè)計(jì)自動(dòng)化
2011-08-08

電路設(shè)計(jì) 抗干擾數(shù)字濾波 CPLD
基于CPLD／FPGA的多串口設(shè)計(jì)與實(shí)現(xiàn)

摘要：在工業(yè)控制中如何提高一對(duì)多的串口通訊可靠性和系統(tǒng)的集成性成為研究熱點(diǎn)。本文利用嵌入式技術(shù)，提出基于CPLD／FPGA的多串口擴(kuò)展設(shè)計(jì)方案。實(shí)現(xiàn)并行口到多個(gè)全雙工異步通訊口之間的轉(zhuǎn)換，并根據(jù)嵌入式系統(tǒng)實(shí)時(shí)

電子設(shè)計(jì)自動(dòng)化
2011-08-01

FPGA 多串口串口設(shè)計(jì) CPLD
基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無(wú)閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。

數(shù)字電源
2011-07-30

嵌入式系統(tǒng) 雙口RAM LED點(diǎn)陣顯示 CPLD
基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

嵌入式教程
2011-07-30

嵌入式系統(tǒng) 雙口RAM LED點(diǎn)陣顯示 CPLD
基于雙DSP的磁軸承數(shù)字控制器容錯(cuò)設(shè)計(jì)

摘要：本文介紹了應(yīng)用于磁軸承的雙DSP熱備容錯(cuò)控制方案，該方案采用時(shí)鐘同步技術(shù)，由總線表決模塊實(shí)現(xiàn)系統(tǒng)的容錯(cuò)處理，硬件判決模塊實(shí)現(xiàn)硬件故障判斷。由中心仲裁模塊根據(jù)兩判決模塊的結(jié)果進(jìn)行復(fù)雜的仲裁，并完成

工業(yè)控制
2011-07-29

DSP 數(shù)字控制器軸承 CPLD
采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法搭建一種低成本的嵌入式視覺系統(tǒng)，系統(tǒng)由CMOS圖像傳感器、CPLD、ARM7微處理器以及SRAM構(gòu)成。其中，CPLD識(shí)別時(shí)序，解決了圖像采集系統(tǒng)存在的嚴(yán)格時(shí)序同步和雙CPU共享一片SRAM的總

數(shù)字電源
2011-07-29

圖像傳感器系統(tǒng)設(shè)計(jì) 視覺系統(tǒng) CPLD
采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

嵌入式教程
2011-07-29

圖像傳感器系統(tǒng)設(shè)計(jì) 視覺系統(tǒng) CPLD
基于雙DSP的磁軸承數(shù)字控制器容錯(cuò)設(shè)計(jì)

摘要：本文介紹了應(yīng)用于磁軸承的雙DSP熱備容錯(cuò)控制方案，該方案采用時(shí)鐘同步技術(shù)，由總線表決模塊實(shí)現(xiàn)系統(tǒng)的容錯(cuò)處理，硬件判決模塊實(shí)現(xiàn)硬件故障判斷。由中心仲裁模塊根據(jù)兩判決模塊的結(jié)果進(jìn)行復(fù)雜的仲裁，并完成

數(shù)字電源
2011-07-27

DSP 數(shù)字控制器軸承 CPLD
用時(shí)差法檢測(cè)液壓系統(tǒng)流量

1 引言液壓系統(tǒng)一直存在故障率高、故障檢測(cè)定位困難的問題。常用的液壓系統(tǒng)振動(dòng)信號(hào)診斷技術(shù)、油液分析診斷技術(shù)已無(wú)法準(zhǔn)確獲得反映液壓系統(tǒng)運(yùn)行狀態(tài)的流量、壓力等關(guān)鍵參數(shù)及其變化；傳統(tǒng)的液壓介入式測(cè)量方法，檢測(cè)

單片機(jī)
2011-07-24

單片機(jī) 液壓系統(tǒng) PULSE CPLD
基于CPLD的USB總線的隔離接口實(shí)現(xiàn)

本設(shè)計(jì)的主要?jiǎng)?chuàng)新點(diǎn)在于 USB總線的協(xié)議的復(fù)雜性和快速性為設(shè)計(jì)實(shí)現(xiàn)必須面對(duì)許多的挑戰(zhàn)，能在分析協(xié)議的基礎(chǔ)上利用 CPLD解決了 USB總線隔離的問題，巧妙的檢測(cè)信息包起始、快切換和包結(jié)束的難題，克服了傳輸信息包結(jié)束慢上拉與過(guò)渡，保證系統(tǒng)的完整性。

模擬
2011-07-14

接口隔離 USB總線 CPLD
基于CPLD和Embedded System的LED點(diǎn)陣顯示

摘要：采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無(wú)閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。LED點(diǎn)陣顯示屏是顯示公共信息的一種重要顯示終端，其中

數(shù)字電源
2011-07-05

EMBEDDED SYSTEM LED點(diǎn)陣顯示 CPLD
基于CPLD和Embedded System的LED點(diǎn)陣顯示

基于CPLD和Embedded System的LED點(diǎn)陣顯示

嵌入式教程
2011-07-05

EMBEDDED SYSTEM LED點(diǎn)陣顯示 CPLD
基于DSP和CPLD的寬帶信號(hào)源的設(shè)計(jì)

基于DSP和CPLD的寬帶信號(hào)源的設(shè)計(jì)

嵌入式教程
2011-07-04

DSP 信號(hào)源寬帶信號(hào) CPLD

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CPLD

DM642和CPLD外部中斷的寄存器式鍵盤設(shè)計(jì)

基于ARM和CPLD的嵌入式視覺系統(tǒng)設(shè)計(jì)

一款基于CPLD的LED顯示屏控制電路解決方案

基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計(jì)與實(shí)現(xiàn)

基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

基于CPLD與絕對(duì)式編碼器的高精度高速伺服單元

基于CPLD的數(shù)字濾波抗干擾電路設(shè)計(jì)

基于CPLD／FPGA的多串口設(shè)計(jì)與實(shí)現(xiàn)

基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

基于雙DSP的磁軸承數(shù)字控制器容錯(cuò)設(shè)計(jì)

采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

基于雙DSP的磁軸承數(shù)字控制器容錯(cuò)設(shè)計(jì)

用時(shí)差法檢測(cè)液壓系統(tǒng)流量

基于CPLD的USB總線的隔離接口實(shí)現(xiàn)

基于CPLD和Embedded System的LED點(diǎn)陣顯示

基于CPLD和Embedded System的LED點(diǎn)陣顯示

基于DSP和CPLD的寬帶信號(hào)源的設(shè)計(jì)

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