分頻器
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分頻器的"階"與"路"
在音箱評測尤其是2.0中高端音箱評測中，大家一定會談到分頻器。對于音箱來說，分頻器是非常重要的。但往往大家容易在對分頻器的描述上出現(xiàn)錯誤，什么是分頻器的“階”，什么是分頻器的“路”，下
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基于VHDL和FPGA的多種分頻的實現(xiàn)方法
基于VHDL和FPGA的多種分頻的實現(xiàn)方法
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教你制作Esquire紳士音箱
Esquire是小型兩路揚聲器，采用單元為Vifa的 P13WH-00-08中低音單元和Vifa的 D27TG-45-06軟球頂高音單元。外型見圖1。 制作這揚聲器的是想通過有限的投資獲得高質量的回報，而且作者也不需要低于80HZ的低頻，
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一種高碼速率的微波鎖相調頻源
摘 要：介紹了準兩點注入式調頻技術，以及相關電路設計和實驗結果。理論分析和實踐表明，準兩點注入式鎖相調頻源具有平坦的寬帶調制特性，能滿足高碼速率測控通信發(fā)射設備的實際要求。關鍵詞： 測控通信 鎖相 調頻源
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TTL集成晶體振蕩器與分頻器
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1488kHz晶體發(fā)生器與分頻器
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高保真揚聲器3路和4路分頻器
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射頻預分頻器ADF500x（ADI）
ADI最近推出新款 射頻預分頻電路，可用于各種應用，包括點到點無線電、VSAT（甚小口徑終端）和微波通信系統(tǒng)。預分頻器電路的作用是產生一個頻率為輸入信號頻率小數(shù)分頻的輸出信號。ADF500x 射頻預分頻器采用業(yè)界領先
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高性能、四路輸出時鐘發(fā)生器MAX3679A（Maxim）
Maxim推出用于以太網設備的高性能、四路輸出時鐘發(fā)生器MAX3679A。器件采用低噪聲VCO和PLL架構，能夠從低頻晶體或參考時鐘輸入產生高頻、超低抖動(0.36psRMS，典型值)時鐘信號。傳統(tǒng)的解決方案需要一個昂貴的晶體振蕩
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一種超低功耗5.8GHz雙模前置分頻器設計
摘要：基于目前流行的TSPC高速電路，利用TSMC90nm 1．P9M 1．2V CMOS工藝設計了高速、低壓、低功耗32／33雙模前置分頻器，其適用于WLAN IEEE802．1la通信標準。運用Mentor Graphics Eldo對該電路進行仿真，仿真結果顯
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一種超低功耗5.8GHz雙模前置分頻器設計
摘要：基于目前流行的TSPC高速電路，利用TSMC90nm 1．P9M 1．2V CMOS工藝設計了高速、低壓、低功耗32／33雙模前置分頻器，其適用于WLAN IEEE802．1la通信標準。運用Mentor Graphics Eldo對該電路進行仿真，仿真結果顯
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基于FPGA的多種分頻設計與實現(xiàn)
0 引言分頻器是FPGA設計中使用頻率非常高的基本單元之一。盡管目前在大部分設計中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來進行時鐘的分頻、倍頻以及相移設計，但是，對于時鐘要求不太嚴格的設計，通過自
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基于ADF4360-1的本振源設計
0 引 言 在無線通信領域，本振信號性能的優(yōu)劣是影響混頻器輸出頻譜純度的主要因素。頻率合成技術是指由一個穩(wěn)定、準確的標準參考頻率，經過一系列的處理過程，產生大量離散的具有同一穩(wěn)定度和準確度的信號頻率
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高性能、三路輸出時鐘發(fā)生器MAX3625B（Maxim）
Maxim近日推出高性能、三路輸出時鐘發(fā)生器MAX3625B，適用于以太網和光纖通道網絡設備。器件采用低噪聲VCO和PLL架構，能夠從低頻晶體或參考時鐘輸入產生高頻、超低抖動(0.36psRMS)時鐘信號。器件具有-57dBc的PSNR，大
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10~37 GHz CMOS四分頻器的設計
1 引言 隨著通信技術的迅猛發(fā)展，人們對通信系統(tǒng)中單元電路的研究也越來越多。而分頻器廣泛應用于光纖通信和射頻通信系統(tǒng)中，因此，高速分頻器的研究也日益受到關注。分頻器按實現(xiàn)方式可分為模擬和數(shù)字兩種。模
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基于CPLD/FPGA的多功能分頻器的設計與實現(xiàn)
引言 分頻器在CPLD/FPGA設計中使用頻率比較高,盡管目前大部分設計中采用芯片廠家集成的鎖相環(huán)資源 ,但是對于要求奇數(shù)倍分頻（如3、5等）、小數(shù)倍（如2.5、3.5等）分頻、占空比50%的應用場合卻往往不能滿足要求。
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基于低噪音單芯片高頻分頻器的PLL設計
VSAT是一種小衛(wèi)星通信系統(tǒng)，可為邊遠地區(qū)的家庭和商業(yè)用戶提供可靠的、具有成本效應的寬帶數(shù)據(jù)和其它業(yè)務。VSAT采用一種小型天線來發(fā)送和接收衛(wèi)星信號，可為所有處于衛(wèi)星覆蓋區(qū)域內的用戶提供高帶寬連接，無論用
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基于CPLD的任意整數(shù)半整數(shù)分頻器設計
0 引言 在數(shù)字系統(tǒng)設計中,根據(jù)不同的設計需要,經常會遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等,有的還要求等占空比。在基于cpld（復雜可編程邏輯器件）的數(shù)字系統(tǒng)設計中,很容易實現(xiàn)由計數(shù)器或其級聯(lián)構成各種形式的偶
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基于ADF4110的頻率發(fā)射系統(tǒng)
摘要：結合美國ADI公司推出低功耗寬帶集成鎖相環(huán)芯片ADF4110的性能特點以及鎖相環(huán)頻率合成器的原理，給出了用ADF4110鎖相環(huán)芯片設計頻率自動跟蹤系統(tǒng)的硬件電路，并給出了頻域和時域的測試結果，表明電路可以進行精確
