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基于JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)
數(shù)字信號(hào)處理技術(shù)是一門(mén)發(fā)展很快的新興學(xué)科，它的應(yīng)用十分廣泛，如通訊、控制、圖像和語(yǔ)音處理、測(cè)量與控制、醫(yī)學(xué)等。[2]數(shù)字信號(hào)處理平臺(tái)主要有 DSP、單片機(jī)、通用 /工控計(jì)算機(jī)、FPGA/CPLD等，文章主要介紹了在進(jìn)行數(shù)字信號(hào)處理時(shí)，利用 JTAG（Joint TEST Advisory GROUP）技術(shù)的仿真器在 CCS平臺(tái)下對(duì) TMS320 C54x系列 DSP芯片實(shí)現(xiàn)在線編程，進(jìn)行在線調(diào)試時(shí)中斷檢測(cè)處理技術(shù)及其應(yīng)用。
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基于JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)
基于JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)
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基于JTAG邊界掃描方式的重構(gòu)控制器的設(shè)計(jì)
引言 JTAG(聯(lián)合測(cè)試行動(dòng)小組)是一種國(guó)際標(biāo)準(zhǔn)測(cè)試協(xié)議(IEEE 1149.1兼容)，目前主要用于芯片內(nèi)部測(cè)試?，F(xiàn)在多數(shù)的高級(jí)器件都支持JTAG協(xié)議，如DSP、FPGA器件等。標(biāo)準(zhǔn)的JTAG接口是4線：TMS(模式選擇)、TCK(時(shí)鐘)、
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基于JTAG邊界掃描方式的重構(gòu)控制器的設(shè)計(jì)
引言 JTAG(聯(lián)合測(cè)試行動(dòng)小組)是一種國(guó)際標(biāo)準(zhǔn)測(cè)試協(xié)議(IEEE 1149.1兼容)，目前主要用于芯片內(nèi)部測(cè)試?，F(xiàn)在多數(shù)的高級(jí)器件都支持JTAG協(xié)議，如DSP、FPGA器件等。標(biāo)準(zhǔn)的JTAG接口是4線：TMS(模式選擇)、TCK(時(shí)鐘)、
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基于FPGA的可層疊組合式SoC原型系統(tǒng)設(shè)計(jì)
為解決單片F(xiàn)PGA無(wú)法滿足復(fù)雜SoC原型驗(yàn)證所需邏輯資源的問(wèn)題，設(shè)計(jì)了一種可層疊組合式超大規(guī)模SoC驗(yàn)證系統(tǒng)。該系統(tǒng)采用了模塊化設(shè)計(jì)，通過(guò)互補(bǔ)連接器和JTAG控制電路，支持最多5個(gè)原型模塊的層疊組合,最多可提供2 500萬(wàn)門(mén)邏輯資源。經(jīng)本系統(tǒng)驗(yàn)證的地面數(shù)字電視多媒體廣播基帶調(diào)制芯片(BHDTMBT1006)已成功流片。
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基于FPGA的可層疊組合式SoC原型系統(tǒng)設(shè)計(jì)
基于FPGA的可層疊組合式SoC原型系統(tǒng)設(shè)計(jì)
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JTAG模式下的MPC5554外部FLASH編程的設(shè)計(jì)與實(shí)現(xiàn)
0 引 言 隨著信息技術(shù)的發(fā)展，嵌入式系統(tǒng)越來(lái)越廣泛地應(yīng)用于手機(jī)通信、汽車、航空航天、工業(yè)控制等領(lǐng)域。在這些電子產(chǎn)品中，大多以嵌人式微處理器為核心，配套相關(guān)的外圍輔助設(shè)備，對(duì)控制對(duì)象進(jìn)行軟硬件的功能
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JTAG模式下的MPC5554外部FLASH編程的設(shè)計(jì)與實(shí)現(xiàn)
0 引 言 隨著信息技術(shù)的發(fā)展，嵌入式系統(tǒng)越來(lái)越廣泛地應(yīng)用于手機(jī)通信、汽車、航空航天、工業(yè)控制等領(lǐng)域。在這些電子產(chǎn)品中，大多以嵌人式微處理器為核心，配套相關(guān)的外圍輔助設(shè)備，對(duì)控制對(duì)象進(jìn)行軟硬件的功能
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JTAG模式下的MPC5554外部FLASH編程的設(shè)計(jì)與實(shí)現(xiàn)
JTAG模式下的MPC5554外部FLASH編程的設(shè)計(jì)與實(shí)現(xiàn)
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TKScope支持JTAG菊花鏈連接的多器件仿真
TKScope支持JTAG菊花鏈連接的多器件仿真
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風(fēng)河JTAG開(kāi)發(fā)工具支持Freescale、Intel和RMI處理器
風(fēng)河系統(tǒng)公司（Wind River）宣布推出Wind River Workbench On-Chip Debugging 3.1.1，將這套綜合性開(kāi)發(fā)工具的支持平臺(tái)拓展到Freescale、Intel和RMI處理器。此前，風(fēng)河的Wind River On-Chip Debugging解決方案已經(jīng)支持
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風(fēng)河JTAG開(kāi)發(fā)工具支持Freescale、Intel和RMI處理器
風(fēng)河JTAG開(kāi)發(fā)工具支持Freescale、Intel和RMI處理器
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利用FPGA的新功能保證視頻設(shè)計(jì)安全性
越來(lái)越多的消費(fèi)應(yīng)用開(kāi)始在設(shè)計(jì)中集成流式視頻，結(jié)果引入了許多標(biāo)準(zhǔn)和專有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大的挑戰(zhàn)。DeviceDNA作為FPGA的一項(xiàng)新功能，可保證
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JTAG控制電路的應(yīng)用與研究
所有邏輯器件的廠商生產(chǎn)的器件都支持JTAG加載電路,它是一種通用的加載電路.幾乎所有的邏輯工程師或硬件開(kāi)發(fā)工程師都曾被這種簡(jiǎn)單的JTAG控制電路困惑過(guò).本人通過(guò)多次的現(xiàn)場(chǎng)應(yīng)用,把JTAG電路的應(yīng)用技巧總結(jié)如下.(以ALTE
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SJTAG技術(shù)在ATCA體系的應(yīng)用
本文將SJTAG技術(shù)應(yīng)用于ATCA架構(gòu)中，根據(jù)ATCA架構(gòu)的特點(diǎn)，將JTAG技術(shù)充分發(fā)揮，克服了普通ATCA測(cè)試/升級(jí)方法速度慢、風(fēng)險(xiǎn)大，存在測(cè)試/升級(jí)盲區(qū)，AMC子卡升級(jí)方式單一，主控板無(wú)法升級(jí)等缺點(diǎn)，將全框都納入了可現(xiàn)場(chǎng)測(cè)試/升級(jí)的范疇。通過(guò)對(duì)AMC子卡升級(jí)方式的靈活改進(jìn)，完善二級(jí)橋片和菊花鏈的兼容模式，不需要被測(cè)單板上任何處理器處于工作狀態(tài)，甚至可以應(yīng)用于出場(chǎng)大批量的升級(jí)和測(cè)試。
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