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改進(jìn)的DAC相位噪聲測(cè)量以支持超低相位噪聲DDS應(yīng)用
這些高性能系統(tǒng)中的系統(tǒng)設(shè)計(jì)人員將選擇超低相位噪聲振蕩器，并且從噪聲角度來(lái)講，信號(hào)鏈的目標(biāo)就是使振蕩器相位噪聲曲線的惡化最小。這就要求對(duì)信號(hào)鏈上的各種元器件做殘余或加性的相位噪聲測(cè)量。最近發(fā)
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直接數(shù)字頻率合成知識(shí)點(diǎn)匯總（原理_組成_優(yōu)缺點(diǎn)_實(shí)現(xiàn)）
本文開(kāi)始介紹了直接數(shù)字頻率合成的概念與原理，其次介紹了直接數(shù)字頻率合成優(yōu)缺點(diǎn)與構(gòu)成，最后介紹了直接數(shù)字頻率合成系統(tǒng)實(shí)現(xiàn)方式。
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DDS 信號(hào)源在掃頻測(cè)試中的應(yīng)用
電子設(shè)計(jì)中經(jīng)常碰到的問(wèn)題是對(duì)待測(cè)電路(DUT)傳輸特性的測(cè)試，這里所說(shuō)的傳輸特性包括增益和衰減、幅頻特性、相位特性和時(shí)延特性等，而最常見(jiàn)的就是DUT 的幅頻特性。
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基于Matlab的DDS線性調(diào)頻信號(hào)的仿真應(yīng)用
直接數(shù)字頻率合成( DDS)是近年來(lái)得到迅速發(fā)展的一種新的頻率合成方法，具有頻率切換速度快，很容易提高頻率分辨率、對(duì)硬件要求低等優(yōu)點(diǎn)。 可編程全數(shù)字化便于單片集成、有
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基于ARM與DDS的高精度正弦信號(hào)發(fā)生器設(shè)計(jì)
隨著電子技術(shù)的不斷發(fā)展與進(jìn)步，現(xiàn)代的電子測(cè)量、通信系統(tǒng)越來(lái)越需要有高精度和靈活的正弦信號(hào)源進(jìn)行測(cè)量和調(diào)試。為了滿足外場(chǎng)試驗(yàn)對(duì)便攜式信號(hào)發(fā)生器的需要，利用直接數(shù)字合成技術(shù)，通過(guò)ARM芯片STM32實(shí)現(xiàn)對(duì)DDS芯片ML2035的控制，產(chǎn)生從0～25 kHz的正弦信號(hào)。結(jié)論表明，使用ARM和ML2035構(gòu)成的正弦信號(hào)源的頻率具有精度高的特點(diǎn)，設(shè)計(jì)方法對(duì)于特定場(chǎng)合的應(yīng)用具有借鑒意義。
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基于實(shí)驗(yàn)系統(tǒng)采用電路可動(dòng)態(tài)重組的設(shè)計(jì)方案
0 引言“ 數(shù)字電路與邏輯設(shè)計(jì)”、“ 可編程邏輯器件與應(yīng)用”、“單片機(jī)原理與應(yīng)用”是電子類相關(guān)專業(yè)的重要專業(yè)課程，在電工電子教學(xué)中占有
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基于DDS的多路任意波形發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)
摘要：本文采用單片機(jī)控制DDS專用芯片(AD9854)設(shè)計(jì)了信號(hào)發(fā)生器。以AD9854芯片為核心，詳細(xì)分析了該信號(hào)發(fā)生器的系統(tǒng)結(jié)構(gòu)、軟硬件設(shè)計(jì)和具體電路實(shí)現(xiàn)，并介紹了使用單片機(jī)STC12LE5A56S2對(duì)AD9854的控制方法。信號(hào)發(fā)生
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基于PLL 和DDS 的跳頻信號(hào)發(fā)生器設(shè)計(jì)
0 引言跳頻信號(hào)源主要由兩部分組成：控制部分和頻率合成部分。頻率合成部分是跳頻信號(hào)源的主要組成部分，頻率合成是利用一個(gè)或多個(gè)高穩(wěn)定晶體振蕩器產(chǎn)生出一系列等間隔的離
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用DDS芯片AD9835開(kāi)發(fā)的精度頻率信號(hào)發(fā)生器
高精度測(cè)量往往需采用高精度、高穩(wěn)定性、高分辨率的頻率信號(hào)源。采用多個(gè)鎖相環(huán)構(gòu)成的頻率合成器，電路復(fù)雜、價(jià)格昂貴，且信號(hào)建立時(shí)間長(zhǎng)、動(dòng)態(tài)特性較差。近年來(lái)發(fā)展起來(lái)的直接數(shù)字式頻率合成器(DDS)采用高速數(shù)字電
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基于DDS與MCU的運(yùn)算放大器參數(shù)測(cè)量系統(tǒng)設(shè)計(jì)
在現(xiàn)代科研機(jī)構(gòu)電路設(shè)計(jì)、大專院校的電子系統(tǒng)教學(xué)中，集成運(yùn)算放大器作為信號(hào)處理的基本器件，應(yīng)用非常廣泛，準(zhǔn)確的掌握集成運(yùn)放的參數(shù)是進(jìn)行電子系統(tǒng)設(shè)計(jì)的基本前提。為了方便用戶準(zhǔn)確掌握手中運(yùn)放的各項(xiàng)參數(shù)，本文
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CPLD 實(shí)現(xiàn)DDS 信號(hào)源的設(shè)計(jì)
中文摘要:利用CPLD 在高速數(shù)據(jù)處理方面的特點(diǎn)設(shè)計(jì)出以VHDL 硬件描述語(yǔ)言為設(shè)計(jì)輸入, 以AL TERA 公司的 EPM 7256 芯片為設(shè)計(jì)載體, 基于DDS 技術(shù)的任意波形信號(hào)發(fā)生器。該信號(hào)發(fā)生器能同時(shí)輸出兩路信號(hào), 輸出信號(hào)的頻
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基于microblaze的手持示波函數(shù)表
一、項(xiàng)目概述 1.1 引言 示波器自1933年誕生至今已經(jīng)有70多年的歷史。它是電子電路設(shè)計(jì)人員用來(lái)觀察波形的主要工具，它可以讓設(shè)計(jì)人員直觀的看到所要觀測(cè)到的波形
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基于DDS驅(qū)動(dòng)PLL結(jié)構(gòu)的Ka波段頻率綜合器
1 引言 毫米波系統(tǒng)在雷達(dá)與制導(dǎo)、電子對(duì)抗、毫米波通信、遙感遙測(cè)等領(lǐng)域中有廣泛的應(yīng)用。作為毫米波系統(tǒng)的關(guān)鍵部件-毫米波頻率源，它性能的好壞直接影響著系統(tǒng)的整體
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基于FPGA+DDS的正弦信號(hào)發(fā)生器的設(shè)計(jì)
1971年，美國(guó)學(xué)者TIERNCY J、TADER C M和GOLD B在《A Digital Frequeney Synthesizer》一文中提出了以全數(shù)字技術(shù)，從相位概念出發(fā)直接合成所需波形的一種新的頻率合成原理，稱之為直接數(shù)字頻率合成器DDS(Direct D
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基于CPLD及DDS的正交信號(hào)源濾波器的設(shè)計(jì)
引言由于傳統(tǒng)的多波形函數(shù)信號(hào)發(fā)生器需采用大量分離元件才能實(shí)現(xiàn)，且設(shè)計(jì)復(fù)雜，這里提出一種基于CPLD的多波形函數(shù)信號(hào)發(fā)生器。它采用 CPLD作為函數(shù)信號(hào)發(fā)生器的處理器，以單片機(jī)和CPLD為核心，輔以必要的模擬和數(shù)字
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基于多片高速D／A AD9739的多通道信號(hào)模擬器
摘要 多元陣天線陣列常被用于偵查和定位系統(tǒng)，相位差變化率則是單站無(wú)源定位中常用的觀測(cè)參數(shù)。文中介紹了一種基于AD公司多片2.5 GSamplc·s-1的高速AD9739型號(hào)D/A轉(zhuǎn)換器，采用DDS技術(shù)的多通道信號(hào)模擬器。經(jīng)
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基于DDS構(gòu)建可調(diào)頻穩(wěn)幅信號(hào)發(fā)生器
摘要 系統(tǒng)采用基于DDS工作原理的AD9851，以單片機(jī)為控制核心，設(shè)計(jì)了可產(chǎn)生頻率可調(diào)的穩(wěn)幅高精度正弦波、方波信號(hào)發(fā)生器。輸出級(jí)通過(guò)橢圓濾波器去除高頻噪聲以穩(wěn)定信號(hào)，并采用乙類推免功率放大器電路以提高系統(tǒng)的負(fù)
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DDS流水線結(jié)構(gòu)的改進(jìn)
摘要：分析了DDS中流水線結(jié)構(gòu)及輸入數(shù)據(jù)在其中移動(dòng)的特點(diǎn)，提出了一種DDS流水線結(jié)構(gòu)的改進(jìn)方案，給出了實(shí)現(xiàn)的方法并作了仿真，分析了對(duì)DDS電路性能的改進(jìn)方案。關(guān)鍵詞：DDS
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CPLD DDS正交信號(hào)源濾波器
桂林電子科技大學(xué) 韓劍 李德明 馮雪1 引言由于傳統(tǒng)的多波形函數(shù)信號(hào)發(fā)生器需采用大量分離元件才能實(shí)現(xiàn)，且設(shè)計(jì)復(fù)雜，這里提出一種基于CPLD的多波形函數(shù)信號(hào)發(fā)生器。它采用CPLD作為函數(shù)信號(hào)發(fā)生器的處理器，以單片機(jī)和
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一種用于FPGA的改進(jìn)算法弱化了方波重影
直接數(shù)字頻率合成技術(shù)（DDS）作為第三代頻率合成技術(shù)，廣泛應(yīng)用于儀器儀表、通信、雷達(dá)等領(lǐng)域。基于DDS技術(shù)設(shè)計(jì)的頻率合成器輸出方波時(shí)，存在明顯的重影現(xiàn)象，這直接影響了方波的質(zhì)量。對(duì)方波重影出現(xiàn)的原因進(jìn)行了分析，并提出一種適用于FPGA的改進(jìn)算法，較好地弱化了方波重影。
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