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基于FPGA的32 Kbit/s CVSD語(yǔ)音編解碼器的實(shí)現(xiàn)
CVSD是一種自適應(yīng)增量脈沖編碼調(diào)制，對(duì)誤碼有很強(qiáng)的魯棒性，擅長(zhǎng)處理丟失和被損壞的語(yǔ)音采樣，編碼器是單比特編碼，和PCM相比不需要復(fù)雜的成幀設(shè)備，并且解碼器中集成了數(shù)字低通濾波器，使得編解碼設(shè)備簡(jiǎn)單，綜合這些優(yōu)越性，CVSD特別適合應(yīng)用于無(wú)線語(yǔ)音通信系統(tǒng)，具有很廣闊的應(yīng)用前景。
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基于FPGA的32 Kbit/s CVSD語(yǔ)音編解碼器的實(shí)現(xiàn)
CVSD是一種自適應(yīng)增量脈沖編碼調(diào)制，對(duì)誤碼有很強(qiáng)的魯棒性，擅長(zhǎng)處理丟失和被損壞的語(yǔ)音采樣，編碼器是單比特編碼，和PCM相比不需要復(fù)雜的成幀設(shè)備，并且解碼器中集成了數(shù)字低通濾波器，使得編解碼設(shè)備簡(jiǎn)單，綜合這些優(yōu)越性，CVSD特別適合應(yīng)用于無(wú)線語(yǔ)音通信系統(tǒng)，具有很廣闊的應(yīng)用前景。
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G.726語(yǔ)音編解碼器在SoPC中的實(shí)現(xiàn)
在對(duì)G.726語(yǔ)音編解碼標(biāo)準(zhǔn)分析的基礎(chǔ)上給出了基于FPGA的DSP的設(shè)計(jì)流程，利用MATLAB/Simulink、DSP Builer和SOPC Builder工具設(shè)計(jì)了G.726語(yǔ)音編解碼器，通過(guò)仿真實(shí)驗(yàn)驗(yàn)證了所設(shè)計(jì)的編解碼器模型的正確性，實(shí)現(xiàn)了編解碼器在SoPC系統(tǒng)中的綜合。
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G.726語(yǔ)音編解碼器在SoPC中的實(shí)現(xiàn)
在對(duì)G.726語(yǔ)音編解碼標(biāo)準(zhǔn)分析的基礎(chǔ)上給出了基于FPGA的DSP的設(shè)計(jì)流程，利用MATLAB/Simulink、DSP Builer和SOPC Builder工具設(shè)計(jì)了G.726語(yǔ)音編解碼器，通過(guò)仿真實(shí)驗(yàn)驗(yàn)證了所設(shè)計(jì)的編解碼器模型的正確性，實(shí)現(xiàn)了編解碼器在SoPC系統(tǒng)中的綜合。
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G.726語(yǔ)音編解碼器在SoPC中的實(shí)現(xiàn)
G.726語(yǔ)音編解碼器在SoPC中的實(shí)現(xiàn)
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多制式語(yǔ)音編解碼算法的DSP設(shè)計(jì)實(shí)現(xiàn)
本文詳細(xì)描述了在TI (Texas Instruments) C55x系列DSP平臺(tái)上集成實(shí)時(shí)實(shí)現(xiàn)0.3kbps至16kbps多種速率語(yǔ)音編解碼算法的方法，及在現(xiàn)有C語(yǔ)言源代碼基礎(chǔ)上優(yōu)化匯編指令的技巧。
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多制式語(yǔ)音編解碼算法的DSP設(shè)計(jì)實(shí)現(xiàn)
本文詳細(xì)描述了在TI (Texas Instruments) C55x系列DSP平臺(tái)上集成實(shí)時(shí)實(shí)現(xiàn)0.3kbps至16kbps多種速率語(yǔ)音編解碼算法的方法，及在現(xiàn)有C語(yǔ)言源代碼基礎(chǔ)上優(yōu)化匯編指令的技巧。
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多制式語(yǔ)音編解碼算法的DSP設(shè)計(jì)實(shí)現(xiàn)
本文詳細(xì)描述了在TI (Texas Instruments) C55x系列DSP平臺(tái)上集成實(shí)時(shí)實(shí)現(xiàn)0.3kbps至16kbps多種速率語(yǔ)音編解碼算法的方法，及在現(xiàn)有C語(yǔ)言源代碼基礎(chǔ)上優(yōu)化匯編指令的技巧。
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基于FPGA的32Kbit/s CVSD語(yǔ)音編解碼器的實(shí)現(xiàn)
筆者結(jié)合FPGA的靈活性、強(qiáng)大的數(shù)字信號(hào)處理能力、較短的開(kāi)發(fā)周期，提出了基于FPGA的32 Kbit/s CVSD語(yǔ)音編解碼器。
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基于FPGA的32Kbit/s CVSD語(yǔ)音編解碼器的實(shí)現(xiàn)
筆者結(jié)合FPGA的靈活性、強(qiáng)大的數(shù)字信號(hào)處理能力、較短的開(kāi)發(fā)周期，提出了基于FPGA的32 Kbit/s CVSD語(yǔ)音編解碼器。
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ADPCM語(yǔ)音編解碼電路設(shè)計(jì)及FPGA實(shí)現(xiàn)
本文闡述了ADPCM語(yǔ)音編解碼VLSI芯片的設(shè)計(jì)方法以及利用FPGA的硬件實(shí)現(xiàn)。
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ADPCM語(yǔ)音編解碼電路設(shè)計(jì)及FPGA實(shí)現(xiàn)
本文闡述了ADPCM語(yǔ)音編解碼VLSI芯片的設(shè)計(jì)方法以及利用FPGA的硬件實(shí)現(xiàn)。
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用L9320實(shí)現(xiàn)ADPCM語(yǔ)音編解碼
文中主要對(duì)L9320編解碼器的工作原理和使用方法進(jìn)行了分析，給出了L9320在便攜式語(yǔ)音系統(tǒng)中的典型應(yīng)用電路。
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用AC4830xC和TCM38C17實(shí)現(xiàn)四路語(yǔ)音編解碼系統(tǒng)
文章介紹了兩種芯片的基本性能及工作原理，并給出了一種基于這兩種芯片設(shè)計(jì)的四路語(yǔ)音編解碼系統(tǒng)的實(shí)現(xiàn)方案。
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