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目標(biāo)識(shí)別

我要報(bào)錯(cuò)

  • 基于Y0L0v3的智慧現(xiàn)場安監(jiān)技術(shù)研究

    摘要:在智能電網(wǎng)發(fā)展的大背景下,目前的電網(wǎng)生產(chǎn)安監(jiān)管理模式已經(jīng)不適應(yīng)智能電網(wǎng)的要求,安監(jiān)管理模式和方式的創(chuàng)新迫在眉睫。鑒于此,首先收集電網(wǎng)違規(guī)場景圖片構(gòu)建VoC數(shù)據(jù)集,利用LabelImg軟件對數(shù)據(jù)集進(jìn)行標(biāo)注:然后采用YoLov3深度學(xué)習(xí)目標(biāo)識(shí)別算法實(shí)現(xiàn)對數(shù)據(jù)集的訓(xùn)練、調(diào)試,并分析模型的性能指標(biāo):最后輸入額外的目標(biāo)樣本測試成功,為后續(xù)更多新技術(shù)應(yīng)用的研究開發(fā)提供了新的思路和方向。

  • 紅外動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn)

    與通用集成電路相比，ASIC芯片具有體積小、重量輕、功耗低、可靠性高等幾個(gè)方面的優(yōu)勢，而且在大批量應(yīng)用時(shí)，可降低成本?，F(xiàn)場可編程門陣列（FPGA）是在專用ASIC的基礎(chǔ)上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點(diǎn)。與其他中小規(guī)模集成電路相比，其優(yōu)點(diǎn)主要在于它有很強(qiáng)的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對電路的修改和維護(hù)很方便。DSP＋FPGA結(jié)構(gòu)最大的特點(diǎn)是結(jié)構(gòu)靈活，有較強(qiáng)的通用性，適于模塊化設(shè)計(jì)，從而能夠提高算法效率；同時(shí)其開發(fā)周期較短，系統(tǒng)易于維護(hù)和擴(kuò)展，適合于實(shí)時(shí)數(shù)字信號(hào)處理。本文介