全數(shù)字鎖相環(huán)

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全數(shù)字鎖相環(huán)的設計及分析

1 引言鎖相環(huán)是一種能使輸出信號在頻率和相位上與輸入信號同步的電路，即系統(tǒng)進入鎖定狀態(tài)(或同步狀態(tài))后，震蕩器的輸出信號與系統(tǒng)輸入信號之間相差為零，或者保持為

數(shù)字電源
2018-08-27

電源技術解析 adpll vhdl語言全數(shù)字鎖相環(huán)
一種新型帶寬自適應全數(shù)字鎖相環(huán)的設計方案

本文針對傳統(tǒng)鎖相環(huán)所存在的鎖相范圍窄、環(huán)路帶寬和控制參數(shù)固定、以及提高鎖相速度與減小穩(wěn)態(tài)誤差相互制約等問題，提出了一種新型帶寬自適應全數(shù)字鎖相環(huán)的設計方案。該設計方案中的系統(tǒng)采用比例積分控制與自適應控制相結合的復合控制方式，其中自適應控制器可根據(jù)鎖相過程的鑒頻鑒相信息，自動調(diào)整數(shù)字濾波器的控制參數(shù)，實現(xiàn)對環(huán)路的實時控制。

數(shù)字電源
2014-01-17

帶寬相位 BSP 全數(shù)字鎖相環(huán)
基于PI控制的全數(shù)字鎖相環(huán)設計

摘要：針對以往全數(shù)字鎖相環(huán)研究中所存在電路結構復雜、設計難度較大和系統(tǒng)性能欠佳等問題，提出了一種實現(xiàn)全數(shù)字鎖相環(huán)的新方法。該鎖相環(huán)以數(shù)字比例積分控制的設計結構取代了傳統(tǒng)的一些數(shù)字環(huán)路濾波控制方法。應用

工業(yè)控制
2013-04-24

控制 PI BSP 全數(shù)字鎖相環(huán)
一種基于VHDL語言的全數(shù)字鎖相環(huán)的實現(xiàn)

　隨著集成電路技術的不斷進步，數(shù)字化應用逐漸普及，在數(shù)字通信、電力系統(tǒng)自動化等方面越來越多地運用了數(shù)字鎖相環(huán)。它的好處在于免去了模擬器件的繁瑣，而且成本低、易實現(xiàn)、省資源。本文綜合以上考慮，在一片F(xiàn)PGA

模擬
2012-11-21

脈沖 VHDL語言 BSP 全數(shù)字鎖相環(huán)
基于FPGA的智能全數(shù)字鎖相環(huán)的設計

1 引言數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學及電力系統(tǒng)自動化等領域中得到了極為廣泛的應用。隨著集成電路技術的發(fā)展，不僅能夠制成頻率較高的單片集成鎖相環(huán)路，而且可以把整個系統(tǒng)集成到一個芯片上去。在基于FP

電子設計自動化
2012-06-21

CPU FPGA 振蕩器全數(shù)字鎖相環(huán)
基于DSP Builder的帶寬自適應全數(shù)字鎖相環(huán)的設計與實現(xiàn)

提出一種設計全數(shù)字鎖相環(huán)的新方法，采用基于PI控制算法的環(huán)路濾波器，在分析模擬鎖相環(huán)系統(tǒng)的數(shù)學模型的基礎上，建立了帶寬自適應全數(shù)字鎖相環(huán)的數(shù)學模型。使用DSP Builder在Matlab／Simulink環(huán)境下搭建系統(tǒng)模型，并采用FPGA實現(xiàn)了硬件電路。軟件仿真和硬件測試的結果證明了該設計的正確性和易實現(xiàn)性。該鎖相環(huán)具有鎖頻速度快、頻率跟蹤范圍寬的特點。同時，系統(tǒng)設計表明基于DSP Builder的設計方法可縮短設計周期，提高設計的靈活性。

消費電子
2010-10-14

DSP 帶寬 BUILDER 全數(shù)字鎖相環(huán)
基于DSP Builder的帶寬自適應全數(shù)字鎖相環(huán)的設計與實現(xiàn)

提出一種設計全數(shù)字鎖相環(huán)的新方法，采用基于PI控制算法的環(huán)路濾波器，在分析模擬鎖相環(huán)系統(tǒng)的數(shù)學模型的基礎上，建立了帶寬自適應全數(shù)字鎖相環(huán)的數(shù)學模型。使用DSP Builder在Matlab／Simulink環(huán)境下搭建系統(tǒng)模型，并采用FPGA實現(xiàn)了硬件電路。軟件仿真和硬件測試的結果證明了該設計的正確性和易實現(xiàn)性。該鎖相環(huán)具有鎖頻速度快、頻率跟蹤范圍寬的特點。同時，系統(tǒng)設計表明基于DSP Builder的設計方法可縮短設計周期，提高設計的靈活性。

數(shù)字電源
2010-10-11

DSP 帶寬 BUILDER 全數(shù)字鎖相環(huán)
采用VHDL設計的全數(shù)字鎖相環(huán)電路設計

摘要:敘述了全數(shù)字鎖相環(huán)的工作原理,提出了應用VHDL 技術設計全數(shù)字鎖相環(huán)的方法,并用復雜可編程邏輯器件CPLD 予以實現(xiàn),給出了系統(tǒng)主要模塊的設計過程和仿真結果。0 　引言全數(shù)字鎖相環(huán)(DPLL) 由于避免了模擬鎖相環(huán)存

電子設計自動化
2010-05-19

電路設計 VHDL設計鎖相環(huán)電路全數(shù)字鎖相環(huán)
一種可編程的全數(shù)字鎖相環(huán)路的實現(xiàn)

鎖相環(huán)路已在模擬和數(shù)字通信及無線電電子學等各個領域中得到了極為廣泛的應用，特別是在數(shù)字通信的調(diào)制解調(diào)和位同步中常常要用到各種各樣的鎖相環(huán)。鎖相就是利用輸入信號與輸出信號之間的相位誤差自動調(diào)節(jié)輸出相位

電子設計自動化
2009-12-15

編程鎖相環(huán)路 BSP 全數(shù)字鎖相環(huán)
一種自動變?？刂频膶掝l帶全數(shù)字鎖相環(huán)

針對傳統(tǒng)的全數(shù)字鎖相環(huán)只能鎖定已知信號和鎖頻范圍較小的問題，提出了一種自動變?？刂频膶掝l帶全數(shù)字鎖相環(huán)。對比分析了各類全數(shù)字鎖相環(huán)鎖頻、鎖相的工作機理，提出了一種新的系統(tǒng)模型，重點研究了快速鎖定和頻帶拓寬的原理及實現(xiàn)方法。應用EDA技術完成系統(tǒng)設計，并進行計算機仿真。仿真結果證實了該設計具有快的鎖定速度、寬的鎖頻范圍、并能快速跟蹤頻率突變的輸入信號。該鎖相環(huán)通用性強，易于集成，可作為IP核用于SoC的設計。

模擬
2009-11-20

頻帶控制 BSP 全數(shù)字鎖相環(huán)
全數(shù)字鎖相環(huán)的設計及分析

　　1 引言　　鎖相環(huán)是一種能使輸出信號在頻率和相位上與輸入信號同步的電路，即系統(tǒng)進入鎖定狀態(tài)(或同步狀態(tài))后，震蕩器的輸出信號與系統(tǒng)輸入信號之間相差為零，或者保持為常數(shù)。傳統(tǒng)的鎖相環(huán)各個部件都是由模擬電

模擬
2009-03-13

PLL AD BSP 全數(shù)字鎖相環(huán)
基于FPGA的全數(shù)字鎖相環(huán)的設計

簡單介紹了全數(shù)字鎖相環(huán)(ADPLL)的結構和工作原理，提出一種在FPGA的基礎上可增大全數(shù)字鎖相環(huán)同步范圍的設計方法，并給出了部分verilog HDL設計程序的代碼和仿真波形。

電子設計自動化
2009-03-10

FPGA PLL BSP 全數(shù)字鎖相環(huán)
基于FPGA的全數(shù)字鎖相環(huán)的設計

基于FPGA的全數(shù)字鎖相環(huán)的設計

嵌入式軟件
2009-03-07

FPGA PLL BSP 全數(shù)字鎖相環(huán)
基于FPGA的高階全數(shù)字鎖相環(huán)的設計與實現(xiàn)

本文提出了一種基于PI 控制算法的三階全數(shù)字鎖相環(huán)，采用EDA 技術進行系統(tǒng)設計，并用可編程邏輯器件予以實現(xiàn)。

電子設計自動化
2007-04-30

FPGA DC BSP 全數(shù)字鎖相環(huán)
基于FPGA的高階全數(shù)字鎖相環(huán)的設計與實現(xiàn)

本文提出了一種基于PI 控制算法的三階全數(shù)字鎖相環(huán)，采用EDA 技術進行系統(tǒng)設計，并用可編程邏輯器件予以實現(xiàn)。

數(shù)字電源
2007-04-27

FPGA DC BSP 全數(shù)字鎖相環(huán)

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全數(shù)字鎖相環(huán)

全數(shù)字鎖相環(huán)的設計及分析

一種新型帶寬自適應全數(shù)字鎖相環(huán)的設計方案

基于PI控制的全數(shù)字鎖相環(huán)設計

一種基于VHDL語言的全數(shù)字鎖相環(huán)的實現(xiàn)

基于FPGA的智能全數(shù)字鎖相環(huán)的設計

基于DSP Builder的帶寬自適應全數(shù)字鎖相環(huán)的設計與實現(xiàn)

基于DSP Builder的帶寬自適應全數(shù)字鎖相環(huán)的設計與實現(xiàn)

采用VHDL設計的全數(shù)字鎖相環(huán)電路設計

一種可編程的全數(shù)字鎖相環(huán)路的實現(xiàn)

一種自動變?？刂频膶掝l帶全數(shù)字鎖相環(huán)

全數(shù)字鎖相環(huán)的設計及分析

基于FPGA的全數(shù)字鎖相環(huán)的設計

基于FPGA的全數(shù)字鎖相環(huán)的設計

基于FPGA的高階全數(shù)字鎖相環(huán)的設計與實現(xiàn)

基于FPGA的高階全數(shù)字鎖相環(huán)的設計與實現(xiàn)

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