EDA
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利用穿心電容實現(xiàn)一種高頻濾波
穿心電容作為旁路電容可以使高頻濾波效果很好，穿心電容具有非常小的寄生電感，旁路阻抗非常小，并且由于采用隔離安裝方式，消除了輸入輸出端之間的高頻耦合。
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主流LCD的驅(qū)動方式和控制方式詳解
會解碼命令，由timing generator產(chǎn)生時序信號，驅(qū)動COM和SEG驅(qū)器。RGB接口：在寫LCD register setTIng時，和MCU接口沒有區(qū)別。區(qū)別只在于圖像的寫入方式。
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高功率PCB的EMC問題處理策略大全
電磁兼容性(EMC)是一個關(guān)鍵問題，它涉及到保證電子設(shè)備在各種環(huán)境下正常運作，不受電磁干擾(EMI)的影響，同時也不對其他設(shè)備產(chǎn)生干擾。
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verilog語法-淺談case casez casex
在rtl仿真中，有四種狀態(tài)，分別是0、1、x(unknown values)和z(high-impedance values)。
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SoC設(shè)計入門 - APB協(xié)議
上一篇主要講述了soc的骨架，crossbar互聯(lián)網(wǎng)路?，F(xiàn)在來講soc的神經(jīng)末梢，它們依附在骨架上，受和調(diào)控制，并將外部信息分享給核心以及其他成員。它是什么呢?
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SoC設(shè)計入門 - APB master設(shè)計（接口類基礎(chǔ)思維）
大家不要以為APB的master和slave很簡單，不需要了解。這是大錯特錯，為什么呢?
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IC設(shè)計：ram的應(yīng)用-使用bitmap實現(xiàn)數(shù)據(jù)壓縮
Bitmap是一種通過位映射來高效存儲和查詢數(shù)據(jù)的技術(shù)，它在處理大規(guī)模數(shù)據(jù)集時能夠有效地節(jié)省內(nèi)存空間。Bitmap技術(shù)特別適用于需要對大量數(shù)據(jù)進行存在性檢查的場景，比如用戶簽到、頁面訪問等，它可以顯著節(jié)省內(nèi)存空間。
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PCIE定位：PCIe需要的debug設(shè)計
本文將以PCIe EP用戶邏輯舉例，描述PCIe可以添加哪些定位手段。如圖所示，PCIe IP作為endpoint與RC對接，用戶實現(xiàn)了應(yīng)用邏輯，與PCIe IP進行交互，交互信號中data格式為TLP報文格式，且交互信號包含相應(yīng)的控制信號，例如PCIe配置空間和IP相干的配置信號。
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IC設(shè)計：ram的折疊設(shè)計
在IC設(shè)計中，我們有時會使用深度很大，位寬很小的ram。例如深度為1024，位寬為4bit的ram。此類的ram有個明顯的缺點：形狀狹長，不利于布局布線、導(dǎo)致讀寫接口走線過長，不利于時序收斂。
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PCIe 定位：鏈路問題定位方法
當PCIe出現(xiàn)鏈路不穩(wěn)定時，如何進行進行問題定位。本文描述的場景：EP PCIe 最高速率為gen4模式，ltssm狀態(tài)機無法持續(xù)穩(wěn)定在L0狀態(tài)。
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IC設(shè)計：clock-gating的綜合實現(xiàn)
在ASIC設(shè)計中，項目會期望設(shè)計將代碼寫成clk-gating風格，以便于DC綜合時將寄存器綜合成clk-gating結(jié)構(gòu)，其目的是為了降低翻轉(zhuǎn)功耗。因為當控制信號（vld_in)無效時，使用了clk-gating后的寄存器，其CK（clk）端口一直為0，因此不存在翻轉(zhuǎn)，能夠有效降低寄存器的翻轉(zhuǎn)功耗和對應(yīng)的時鐘樹的翻轉(zhuǎn)功耗。如下所示：下圖左側(cè)是DC綜合后的clk -gating結(jié)構(gòu)圖，使用了ICG模塊進行時鐘gating，被gating后的時鐘連接到寄存器的CK端。右側(cè)是沒有被clk-gating的寄存器結(jié)構(gòu)圖。
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verilog語法-使用function提高效率
function的作用返回一個數(shù)值，此數(shù)值由一串組合邏輯代碼計算得到。 那為什么要用function呢?主要有兩大原因：
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SoC設(shè)計入門 - 建立時間與保持時間
SOC設(shè)計人員除了做好自己的設(shè)計工作外，還需要和DC等后端(中端)同事進行工作上的交互。
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五步驟設(shè)計出符合電磁兼容性的 DC/DC 開關(guān)電源
DC/DC開關(guān)電源由于其效率高、體積小等優(yōu)點是現(xiàn)代電子產(chǎn)品設(shè)計中不可或缺的一環(huán)，其重要性不言而喻。
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達林頓繼電器驅(qū)動器進行設(shè)計時降低 EMI 的 4 個步驟
電磁干擾有傳導(dǎo)干擾和輻射干擾兩種。傳導(dǎo)干擾是指通過導(dǎo)電介質(zhì)把一個電網(wǎng)絡(luò)上的信號耦合(干擾)到另一個電網(wǎng)絡(luò)。
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