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基于FPGA的Viterbi譯碼器設(shè)計(jì)及實(shí)現(xiàn)
卷積碼是廣泛應(yīng)用于衛(wèi)星通信、無線通信等各種通信系統(tǒng)的信道編碼方式。Viterbi算法是一種最大似然譯碼算法。在碼的約束度較小時(shí)，它比其它概率譯碼算法效率更高、速度更
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基于FPGA的Viterbi譯碼器設(shè)計(jì)及實(shí)現(xiàn)
卷積碼是廣泛應(yīng)用于衛(wèi)星通信、無線通信等各種通信系統(tǒng)的信道編碼方式。Viterbi算法是一種最大似然譯碼算法。在碼的約束度較小時(shí)，它比其它概率譯碼算法效率更高、速度更
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HDTV接收機(jī)呂Viterbi譯碼器的FPGA實(shí)現(xiàn)
高清晰度數(shù)字電視（HDTV）技術(shù)是當(dāng)今世界上最先進(jìn)的圖像壓縮編碼技術(shù)和數(shù)字通信技術(shù)的結(jié)合。它代表一個(gè)國(guó)的科技綜合實(shí)力，蘊(yùn)藏著巨大的市場(chǎng)潛力。數(shù)字電視地面廣播編碼正交頻分復(fù)用（CMOFDM）傳輸系統(tǒng)以其較強(qiáng)的抗多
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基于FPGA的Viterbi譯碼器設(shè)計(jì)
摘要：卷積碼及其Viterbi譯碼是現(xiàn)代通信系統(tǒng)中常用的一種信道編碼方法。文中介紹了Viterbi譯碼算法的原理，分析了Viterbi譯碼器的結(jié)構(gòu)，然后用Verilog語言設(shè)計(jì)了一種基于Altera公司的EP3C120F780C8芯片的(2，l，7)Vi
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