在數(shù)字集成電路設(shè)計中,時鐘門控技術(shù)是降低動態(tài)功耗的關(guān)鍵手段。隨著芯片規(guī)模和復(fù)雜度的不斷增加,對時鐘門控技術(shù)的優(yōu)化需求也日益迫切。ODCG(Optimized Dynamic Clock Gating)和SDCG(Smart Dynamic Clock Gating)作為先進的時鐘門控技術(shù),結(jié)合可達性分析,能夠進一步提升時鐘門控的效果,實現(xiàn)更高效的功耗優(yōu)化。
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