EP1C6Q240

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基于EP1C6Q240C8和VHDL的定時器模塊化方案設計

本設計采用可編程芯片和VHDL語言進行軟硬件設計，不但可使硬件大為簡化，而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達到50 MHz，因而計時精度很高。本設計采用逐位設定預置時間，其最長時間設定可長達99小

電子設計自動化
2012-08-19

定時器模塊化 VHDL EP1C6Q240
利用EP1C6Q240C8處理器的LCD滾屏設計

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嵌入式軟件
2012-02-13

LCD 處理器 BSP EP1C6Q240
利用EP1C6Q240C8處理器的LCD滾屏設計

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2012-02-13

LCD 處理器 BSP EP1C6Q240
基于EP1C6Q240C8和VHDL的定時器的方案設計

本設計采用可編程芯片和VHDL語言進行軟硬件設計，不但可使硬件大為簡化，而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達到50 MHz，因而計時精度很高。本設計采用逐位設定預置時間，其最長時間設定可長達99小

電子設計自動化
2012-01-09

BSP 定時器 VHDL EP1C6Q240
基于EP1C6Q240C8和VHDL的定時器的方案設計

本設計采用可編程芯片和VHDL語言進行軟硬件設計，不但可使硬件大為簡化，而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達到50 MHz，因而計時精度很高。本設計采用逐位設定預置時間，其最長時間設定可長達99小

數(shù)字電源
2012-01-07

BSP 定時器 VHDL EP1C6Q240
采用EP1C6Q240C8和VHDL的定時器的設計

本設計采用可編程芯片和VHDL語言進行軟硬件設計，不但可使硬件大為簡化，而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達到50 MHz，因而計時精度很高。本設計采用逐位設定預置時間，其最長時間設定可長達99小

電子設計自動化
2010-07-06

BSP 定時器 VHDL EP1C6Q240
采用EP1C6Q240C8和VHDL的定時器的設計

本設計采用可編程芯片和VHDL語言進行軟硬件設計，不但可使硬件大為簡化，而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達到50 MHz，因而計時精度很高。本設計采用逐位設定預置時間，其最長時間設定可長達99小

數(shù)字電源
2010-07-04

BSP 定時器 VHDL EP1C6Q240

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EP1C6Q240

基于EP1C6Q240C8和VHDL的定時器模塊化方案設計

利用EP1C6Q240C8處理器的LCD滾屏設計

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基于EP1C6Q240C8和VHDL的定時器的方案設計

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采用EP1C6Q240C8和VHDL的定時器的設計

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