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1553B總線中曼徹斯特編解碼器的設(shè)計(jì)
曼徹斯特鳊解碼器是1553B總線協(xié)議的重要組成部分，其性能的好壞直接影響整個(gè)系統(tǒng)的通信質(zhì)量。通過分析MIL STD-1553B協(xié)議和GJB5186測試標(biāo)準(zhǔn)，制定出鳊解碼器的設(shè)計(jì)規(guī)范。采用硬件描述語言(Verilog)設(shè)計(jì)電路，VCS對設(shè)計(jì)進(jìn)行仿真，并利用Synplify Pro及ISE完成綜合和布局布線的工作，最后載入Xilinx FPGA進(jìn)行測試。在深入分析曼徹斯特碼型特點(diǎn)的基礎(chǔ)上，對鳊解碼器的工作過程及邏輯電路結(jié)構(gòu)進(jìn)行詳細(xì)介紹。提出的時(shí)鐘分離電路比超前滯后數(shù)字鎖相環(huán)更為簡單有效。
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一種基于CPLD的曼徹斯特編解碼器設(shè)計(jì)
本設(shè)計(jì)具有一定的通用性，它的邏輯大部分只涉及到編、解碼器本身；而它與外部的接口十分簡單，只要對其讀、寫并對跳變沿信號進(jìn)行有效控制，就能使其正常工作。本設(shè)計(jì)十分獨(dú)立，由于選用器件資源比較豐富，故對其進(jìn)行功能添加也十分方便，只需添加電路設(shè)計(jì)而不必對原有電路進(jìn)行修改。
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一種基于CPLD的曼徹斯特編解碼器設(shè)計(jì)
本設(shè)計(jì)具有一定的通用性，它的邏輯大部分只涉及到編、解碼器本身；而它與外部的接口十分簡單，只要對其讀、寫并對跳變沿信號進(jìn)行有效控制，就能使其正常工作。
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用CPLD控制曼徹斯特編解碼器
討論如何使用CPLD實(shí)現(xiàn)單片機(jī)與曼徹斯特編解碼器的接口。
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