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規(guī)范的重要性：verilog學(xué)習(xí)五點(diǎn)經(jīng)驗(yàn)分享
來(lái)源：射頻百花譚規(guī)范很重要工作過(guò)的朋友肯定知道，公司里是很強(qiáng)調(diào)規(guī)范的，特別是對(duì)于大的設(shè)計(jì)（無(wú)論軟件還是硬件），不按照規(guī)范走幾乎是不可實(shí)現(xiàn)的。邏輯設(shè)計(jì)也是這樣：如果不按規(guī)范做的話，過(guò)一個(gè)月后調(diào)試時(shí)發(fā)現(xiàn)有錯(cuò)，回頭再看自己寫(xiě)的代碼，估計(jì)很多信號(hào)功能都忘了，更不要說(shuō)檢錯(cuò)了；如果一個(gè)項(xiàng)目做...
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一種可配置的EDA仿真驗(yàn)證方法
介紹了一種適用于5000邏輯單元以上規(guī)模電路的可配置EDA仿真驗(yàn)證方法?它由可配置的測(cè)試臺(tái)生成器自動(dòng)產(chǎn)生測(cè)試臺(tái)，并管理測(cè)試向量的注人和仿真狀態(tài)的存儲(chǔ).與以往研究采用的定時(shí)觸發(fā)的激勵(lì)信號(hào)注人方式不同，本方法采用事件觸發(fā)，從而保持了與被測(cè)電路仿真過(guò)程的實(shí)時(shí)交互.自動(dòng)生成測(cè)試臺(tái)代碼可避免設(shè)計(jì)人員進(jìn)行重復(fù)性編碼并提高了可靠性 事件觸發(fā)的仿真狀態(tài)保存機(jī)制大大節(jié)省了存儲(chǔ)空間.
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一種模擬除法器的設(shè)計(jì)及仿真驗(yàn)證CMOS工藝
本文設(shè)計(jì)了一種模擬除法器，在分析討論其工作原理的基礎(chǔ)上，采用CSMC0.5umCMOS工藝，對(duì)電路進(jìn)行了Cadence Spectre 模擬仿真，仿真結(jié)果驗(yàn)證了理論分析。1 電路的設(shè)計(jì)與分析圖1 CCII 電路結(jié)構(gòu)模擬除法器由單電源+5V供
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一種模擬除法器的設(shè)計(jì)及仿真驗(yàn)證CMOS工藝
本文設(shè)計(jì)了一種模擬除法器，在分析討論其工作原理的基礎(chǔ)上，采用CSMC0.5umCMOS工藝，對(duì)電路進(jìn)行了Cadence Spectre 模擬仿真，仿真結(jié)果驗(yàn)證了理論分析。1 電路的設(shè)計(jì)與分析圖1 CCII 電路結(jié)構(gòu)模擬除法器由單電源+5V供
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一種DSP內(nèi)嵌DARAM的電路設(shè)計(jì)與ADvance MS仿真驗(yàn)證
摘要：介紹了一種DSP芯片內(nèi)嵌DARAM的電路結(jié)構(gòu)，詳細(xì)分析了接口電路中各個(gè)模塊的功能，包括地址譯碼電路，字線譯碼電路，位線選擇電路及控制電路四部分內(nèi)容。著重介紹了控制電路的原理，及如何實(shí)現(xiàn)一個(gè)周期“雙存
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軟硬件融合之EDA篇：明導(dǎo)，借Veloce硬件平臺(tái)加速仿真驗(yàn)證
作為EDA廠商的代表，明導(dǎo)公司在硬件平臺(tái)開(kāi)發(fā)方面投入了大量的資源。擁有20多年的硬件加速仿真加速器經(jīng)驗(yàn)，并且在全球的研發(fā)人員超過(guò)200多人。其推出的Veloce 系列產(chǎn)品提供了高性能的仿真加速（Simulation Accelerati
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基于82C52功能仿真驗(yàn)證的研究
摘 要：首先介紹了利用仿真工具進(jìn)行電路功能仿真驗(yàn)證的過(guò)程與方法，以及仿真方案的確定，并以82C52為例詳細(xì)闡述了仿真驗(yàn)證中激勵(lì)文件的編寫(xiě)和對(duì)82C52進(jìn)行功能驗(yàn)證的具體步驟。最后簡(jiǎn)單介紹了82C52的功能及其中各種
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基于軟件仿真驗(yàn)證的運(yùn)放電路設(shè)計(jì)方法
基于軟件仿真驗(yàn)證的運(yùn)放電路設(shè)計(jì)方法
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回看過(guò)去10年芯片仿真驗(yàn)證
全球IC設(shè)計(jì)與10年之前有很大差別，那時(shí)EVE公司剛開(kāi)始設(shè)計(jì)它的第一個(gè)產(chǎn)品。在2000年時(shí)半導(dǎo)體業(yè)正狂熱的進(jìn)入一個(gè)新時(shí)代?！ 』乜茨菚r(shí)，工藝技術(shù)是180納米及設(shè)計(jì)晶體管的平均數(shù)在2000萬(wàn)個(gè)。一個(gè)ASIC平均100萬(wàn)門(mén)，而大的
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回看過(guò)去10年芯片仿真驗(yàn)證
回看過(guò)去10年芯片仿真驗(yàn)證
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一個(gè)FPGA高手的總結(jié)
很早之前就想對(duì)這幾個(gè)月工作經(jīng)歷寫(xiě)的東西，一是作為自己的總結(jié)，二是自己也很想將自己這段時(shí)間的一些經(jīng)歷和大家分享一下，希望對(duì)初學(xué)者而言能使得他們能少走一些彎路。只是公司里的事情很多，最近經(jīng)常加班，所以
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一個(gè)FPGA高手的總結(jié)
一個(gè)FPGA高手的總結(jié)
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三階電荷泵鎖相環(huán)系統(tǒng)級(jí)設(shè)計(jì)與仿真驗(yàn)證
本文采用鎖相環(huán)開(kāi)環(huán)傳輸函數(shù)波特圖對(duì)三階電荷泵鎖相環(huán)進(jìn)行了系統(tǒng)級(jí)設(shè)計(jì)，并且對(duì)相位裕度與建立時(shí)間，穩(wěn)定性與環(huán)路帶寬這兩對(duì)矛盾進(jìn)行了權(quán)衡。
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[心情日記](méi)論文答辯順利通過(guò)
整個(gè)答辯過(guò)程還比較順利，最終也通過(guò)了答辯，心里還是蠻高興的。晚上和大家一起吃飯，氣氛也很好，每個(gè)人都喝了點(diǎn)酒。這里我要感謝我的導(dǎo)師對(duì)我兩年多來(lái)的培養(yǎng)，同時(shí)還要感謝我的師母。最后希望我不要被抽盲審，否則就要多浪費(fèi)一些時(shí)間，時(shí)間太寶貴了啊。
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