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[導(dǎo)讀]2009年以來(lái)40G DWDM已開始在中國(guó)規(guī)模部署,隨著寬帶中國(guó)、寬帶提速等戰(zhàn)略的實(shí)施,發(fā)達(dá)省份的骨干傳輸帶寬資源在這快速發(fā)展的3年中已幾乎消耗殆盡,部分運(yùn)營(yíng)商在第二平面建設(shè)方案是基于40G技術(shù)還是100G DWDM技術(shù)而舉棋

2009年以來(lái)40G DWDM已開始在中國(guó)規(guī)模部署,隨著寬帶中國(guó)、寬帶提速等戰(zhàn)略的實(shí)施,發(fā)達(dá)省份的骨干傳輸帶寬資源在這快速發(fā)展的3年中已幾乎消耗殆盡,部分運(yùn)營(yíng)商在第二平面建設(shè)方案是基于40G技術(shù)還是100G DWDM技術(shù)而舉棋不定。2011年歐美運(yùn)營(yíng)商在云計(jì)算、IDC互聯(lián)、移動(dòng)互聯(lián)網(wǎng)等業(yè)務(wù)的驅(qū)動(dòng)下規(guī)模部署100G技術(shù),毫無(wú)疑問為100G的商用產(chǎn)生了多米諾骨牌效應(yīng)。2012年伊始,國(guó)內(nèi)三大運(yùn)營(yíng)商分別啟動(dòng)詳細(xì)的實(shí)驗(yàn)室和現(xiàn)網(wǎng)測(cè)試,業(yè)界也逐步將注意力從為什么建設(shè)100G轉(zhuǎn)移到如何建設(shè)100G。OSNR,DWDM系統(tǒng)最典型也最復(fù)雜的指標(biāo),也繼PDM-DPSK碼型歸于統(tǒng)一之后成為新的熱點(diǎn)。與40G各種類型來(lái)區(qū)分應(yīng)用場(chǎng)景不同,統(tǒng)一碼型和統(tǒng)一調(diào)制方式的100G DWDM留給廠商進(jìn)行各自優(yōu)化的空間并不大,只有接收側(cè)的AD高速數(shù)模轉(zhuǎn)換、DSP的軟件算法以及FEC編解碼深度。與工程設(shè)計(jì)相關(guān)的顯性指標(biāo),就體現(xiàn)在背靠背OSNR(BOL和EOL)、OSNR和系統(tǒng)代價(jià)、FEC糾錯(cuò)能力、色度色散和偏振模色散補(bǔ)償值上。

B2B OSNR 的優(yōu)化

工程實(shí)踐往往和實(shí)驗(yàn)室測(cè)試有較大差距。在建議的1dBm的發(fā)送功率下,第一代100G系統(tǒng)的B2B仿真數(shù)據(jù)維持15~16dB。在7%線路開銷的112Gbit/s PDM-QPSK相干系統(tǒng)中,在誤碼率為2E~3這個(gè)閾值下,B2B OSNR性能的離線數(shù)據(jù)最佳結(jié)果為14.78dB。也有廠商離線測(cè)試結(jié)果在15~16dB。由于仿真系統(tǒng)一般采用計(jì)算機(jī)陣列的離線處理,一般認(rèn)為商用系統(tǒng)上性能會(huì)比仿真結(jié)果大1.5dB。原因在于離線處理為獲取最佳的B2B OSNR性能而忽略考慮算法本身的復(fù)雜度,但是在線DWDM處理系統(tǒng)必須考慮算法復(fù)雜度限制,性能必然有所劣化?;谝陨戏抡娼Y(jié)果,即使退而使用15~16dB的指標(biāo),其與40G系統(tǒng)的背靠背門限分別為13dB或14.5dB不小的差距。

實(shí)際上PDM-DPSK和相干接收的基本原理在誕生之初就提供了優(yōu)化方案,即本地偏振光源性能“凈化度”的提升。相干接收側(cè)使用一個(gè)高穩(wěn)定度的本地振蕩激光器,經(jīng)過偏振分束后與遠(yuǎn)端輸入光信號(hào)進(jìn)行90度混頻,90度混頻器輸出一個(gè)偏振態(tài)的兩路信號(hào)?;祛l器輸出光信號(hào)經(jīng)平衡接收光電二極管轉(zhuǎn)換為模擬電信號(hào),經(jīng)高速模數(shù)轉(zhuǎn)換器(ADC)采樣量化后轉(zhuǎn)換為數(shù)字信號(hào)。基于以上原理,源自本振光源的信噪比要遠(yuǎn)優(yōu)于輸入光信號(hào)的信噪比,我們能夠改變本地光源的“純度”,就可提升接收端光信噪比約2dB的改善。同理,通過這樣的方法,就可以將B2B的OSNR從15~16dB降低到13~13.5dB。這個(gè)優(yōu)化的數(shù)據(jù)基本上可達(dá)到犧牲20%帶寬效率的SD-FEC的方案指標(biāo)。阿爾卡特朗訊在2011年第4季度發(fā)布了基于商用系統(tǒng)的增強(qiáng)OTU解決方案。并在不開啟SD-FEC的情況下,在2012年第1季度某國(guó)家級(jí)測(cè)試中已優(yōu)于以上關(guān)鍵指標(biāo)。

Q余量與Rm側(cè)系統(tǒng)OSNR的優(yōu)化

40G DWDM國(guó)標(biāo)中定義的MPI-Rm 參考點(diǎn)接收OSNR與背靠背OSNR 容限(EOL)值之間的差值要求為4.5~5dB,OSNR裕度的多少將直接決定系統(tǒng)的OSNR門限。

相對(duì)40G標(biāo)準(zhǔn),基于偏振復(fù)用相干檢測(cè)的100G技術(shù)天生對(duì)DGD和色度色散不敏感,因此可將Q裕量從40G系統(tǒng)中的3~3.5dB下降到2~2.5dB。Q裕量的變化實(shí)際上就是系統(tǒng)側(cè)的OSNR裕量,就可以降低1dB, 達(dá)到4~4.5dB。目前這個(gè)裕量的優(yōu)化已廣泛地被歐洲和北美運(yùn)營(yíng)商所接受。通過這個(gè)方案優(yōu)化和適度的裕量放松,在不采用額外增加帶寬開銷的情況(例如SD-FEC)下,100G系統(tǒng)的ONSR門限就可達(dá)到18.5dB, 完全與現(xiàn)有的40G系統(tǒng)在跨站設(shè)置上相同,甚至優(yōu)于某些特殊碼型的40G 系統(tǒng)。

FEC和SD-FEC的優(yōu)化技術(shù)

前向糾錯(cuò)FEC技術(shù)是通過優(yōu)化線路信號(hào)來(lái)優(yōu)化OSNR性能的一種有效途徑。其本質(zhì)是通過犧牲有效帶寬,以編碼冗余度(如20%)以及對(duì)應(yīng)的信號(hào)處理芯片的復(fù)雜度來(lái)?yè)Q取更大的凈增益。業(yè)界在密切關(guān)注100G超長(zhǎng)傳輸距離和SD-FEC軟判決的關(guān)系。

OIF建議軟判決FEC開銷比小于20%,低于20%開銷比時(shí)凈增益隨著冗余度增加而增大,而超過后受錯(cuò)誤平層影響而增益反而下降。在7%開銷時(shí),軟判決復(fù)雜度遠(yuǎn)超過硬判決,但復(fù)雜度換取的的增益卻十分有限,所以并不建議使用軟判決。因此,可以直觀地判斷并不是軟判決出現(xiàn)之后,硬判決將退出歷史舞臺(tái),軟硬結(jié)合才是可行的方案。

在軟判決具體的碼型方案中,無(wú)論是LDPC 碼還是TPC方案,均需要OTU上完成大量的硬件計(jì)算來(lái)支撐性能。為捕捉信號(hào)遠(yuǎn)離介于0和1之外的信號(hào)而做出正確的判決,譯碼器的比特吞吐量也是硬判決的好幾倍,對(duì)應(yīng)系統(tǒng)的算法復(fù)雜性大為增加。更重要的是,由于啟用軟判決后線路速度從7%開銷的112Gbit/s 速度上升到基于20%開銷冗余的128Gbit/s后,由于速率的提高必然帶來(lái)譜寬的變化,對(duì)后級(jí)ADC器件的采樣率要求從56GHz提升到65GHz, DSP的計(jì)算能力也要從千萬(wàn)門電路往數(shù)千萬(wàn)門級(jí)大躍進(jìn),系統(tǒng)關(guān)鍵芯片的搭建也將從基于100G轉(zhuǎn)變?yōu)槌?00G甚至400G而設(shè)計(jì)。

基于128Gbit/s相干接收系統(tǒng)中,實(shí)驗(yàn)室仿真結(jié)果B2B OSNR在同樣誤碼率門限情況下為14.5 dB。OFC 2010年報(bào)道的國(guó)外某首個(gè)128Gbit/s速率PM-QPSK相干接收在線處理原型機(jī)的真實(shí)測(cè)試結(jié)果卻讓20%冗余度的SD-FEC技術(shù)蒙上陰影。其在2E-3誤碼率下的B2B OSNR門限居然裂化到17dB。究其原因,除了仿真系統(tǒng)和在線系統(tǒng)復(fù)雜度的差異之外,另一個(gè)重要的因素是在線實(shí)時(shí)芯片處理能力。這個(gè)案例也從側(cè)面證明了FPGA拼接而成而不是基于單ASIC芯片,無(wú)法真正完成SD-FEC功能。業(yè)界認(rèn)為,即使采用ASCI技術(shù)也需要65nm甚至40nm工藝的ASIC才能實(shí)現(xiàn)其高運(yùn)算量和低功耗目標(biāo),所以芯片技術(shù)成為軟判決從紙上談兵走向商用系統(tǒng)的關(guān)鍵。

2012年第一季度,at&t實(shí)驗(yàn)室發(fā)布了其業(yè)界首個(gè)40nm的技術(shù)的MSA收發(fā)器的系統(tǒng)測(cè)試結(jié)果,也是業(yè)界首個(gè)運(yùn)營(yíng)商測(cè)試的SD-FEC系統(tǒng)。其有4個(gè)8位、每秒65G采樣率ADC轉(zhuǎn)換通道的DSP引擎,在具體的碼型算法上,試驗(yàn)系統(tǒng)的SD-FEC采用的是基于Turbo乘積碼(TPC),相應(yīng)的凈編碼增益11.1分貝。雖然at&t這個(gè)實(shí)驗(yàn)室測(cè)試系統(tǒng)受成40nm ASIC熟套片數(shù)量的限制,只開通了SD-FEC的波,遠(yuǎn)低于國(guó)內(nèi)40個(gè)波長(zhǎng)的測(cè)試要求;系統(tǒng)的發(fā)射光功率也大于國(guó)內(nèi)標(biāo)準(zhǔn)的1~2dB(這會(huì)改善ONSR性能),但它畢竟為高性能芯片將SD-FEC帶入實(shí)踐商用做出了積極的嘗試。

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