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DSP的維特比譯碼程序優(yōu)化設(shè)計
卷積碼因為其編碼器簡單、編碼增益高以及具有很強(qiáng)的糾正隨機(jī)錯誤的能力，在通信系統(tǒng)中得到了廣泛的應(yīng)用?；谧畲笏迫粶?zhǔn)則的維特比算法(VA)是在加性高斯白噪聲(AWGN)信道下性能最佳的卷積碼
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基于TMS320C6000系列DSP的維特比譯碼程序優(yōu)化設(shè)計
在軟件無線電技術(shù)中,經(jīng)常采用DSP芯片實現(xiàn)信道解碼,但維特比譯碼算法在DSP上的運(yùn)行速度限制了DSP譯碼在高速實時系統(tǒng)中的應(yīng)用。針對TMS320C6000系列DSP的特點,提出了一種優(yōu)化的譯碼程序設(shè)計方案。利用DSP的并行運(yùn)算能力,極大地縮短了譯碼器中“加比選”單元的運(yùn)算時間。優(yōu)化后的程序比優(yōu)化前的程序在譯碼速度上提高了約4倍。當(dāng)在167MHz的TMS320C6701上運(yùn)行的時候,對(2,1,7)卷積碼的譯碼速度可以達(dá)到870kbps。
