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FPGA中定時(shí)循環(huán)啟動(dòng)開銷測(cè)試
1. 背景及目的 在FPGA代碼中，會(huì)遇到將定時(shí)循環(huán)嵌入非定時(shí)循環(huán)的情況，此時(shí)定時(shí)循環(huán)將反復(fù)啟動(dòng)和停止。這個(gè)定時(shí)循環(huán)的時(shí)間開銷如何，需要測(cè)試驗(yàn)證。 定時(shí)循環(huán)的時(shí)間開銷應(yīng)包含兩個(gè)方面：1.定時(shí)循環(huán)的啟動(dòng)開銷，2
