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3G系統(tǒng)中AGC的FPGA設計實現(xiàn)
大多數(shù)接收機必須處理動態(tài)范圍很大的信號，這需要進行增益調(diào)整，以防止過載或某級產(chǎn)生互調(diào)，調(diào)整解調(diào)器的工作以優(yōu)化工作。
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基于DSP技術的多路語音實時采集與壓縮處理系統(tǒng)
介紹一個多路語音實時采集與壓縮處理系統(tǒng)。該系統(tǒng)基于PC－ISA總線結(jié)構(gòu)，最大的特點是通過單片DSP高性能價格比實時地實現(xiàn)了多達10路的語音采集和10路語音實時壓縮及一路語音解壓處理。該系統(tǒng)已成功應用于某語音記錄設備中。
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一種基于DSP和采樣ADC的數(shù)字鎖定放大器
探討了用DSP（數(shù)字信號處理器）和采樣ADC（模數(shù)轉(zhuǎn)換器）實現(xiàn)數(shù)字鎖定放大器的一種方法。
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Stratix II FPGA系統(tǒng)電源設計
基于MAX1951的諸多特點，本文給出了采用該器件為Stratix II FPGA系統(tǒng)供電以降低其功耗的設計方案。
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基于DRFM的欺騙干擾與雷達目標模擬實現(xiàn)
本文介紹了單個通道多目標模擬時對多普勒頻移參數(shù)的實時控制方法，以及多個通道模擬多個信號時的實時控制方法，提出了信號間同步的解決方法。
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基于PIC單片機的電波數(shù)碼顯示時鐘的設計
電波鐘是新興的準確計時產(chǎn)品，是把原子振動的頻率引出來作為計時基準.設計以PIC16F873單片機為核心，由接收單元，中央處理顯示單元和電源單元三個主要部分構(gòu)成，用于接收原子發(fā)射臺以超長波間歇性發(fā)射的信號，以獲得更加準確的時間，在軍事和科學實驗以及人們?nèi)粘Ｉ钪卸加袕V泛的應用前景。
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基于數(shù)字信號處理的新型車載減震檢測方法研究
介紹了一種基于數(shù)字信號處理的新型車載減震檢測方法，本方法利用汽車輪胎壓力監(jiān)測系統(tǒng)(TPMS)檢測的加速度信號（系統(tǒng)在進行胎壓監(jiān)測的同時，自動為減震系統(tǒng)提供檢測數(shù)據(jù)），并用數(shù)字信號處理方法提取出震動加速度值。給出了此方法的理論推導及其軟件仿真實例。
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基于FPGA的智能控制器設計及測試方法研究
通過模糊自整定PID控制器的設計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現(xiàn)的智能控制器設計及測試新方法。
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利用Virtex-5 SXT的高性能DSP解決方案
Xilinx Virtex-5 SXT FPGA 平臺提供了獨特的單芯片解決方案，充分利用大規(guī)模并行計算達到超高性能，同時將功耗降到最低。
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基于USB 2.0集成芯片的H.264解碼器芯片設計
H.264/AVC標準具有一系列優(yōu)于MPEG4和H.263的新特性，在相同的重建圖像質(zhì)量下，H.264比H.263節(jié)約50％左右的碼率。
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基于DSP的TETRA話音編碼設計與實現(xiàn)
本文主要介紹了該系統(tǒng)中話音編碼算法，并討論了其在DSP上實現(xiàn)的具體流程。
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基于DSP的簡單、經(jīng)濟、實用的無功補償器設計
介紹了應用在風力發(fā)電機組電控系統(tǒng)中無功補償控制器的研制，此控制器實現(xiàn)基于DSP的對電網(wǎng)電壓和從發(fā)電機流出的電流快速、準確的檢測
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利用Virtex-5 FPGA降低功耗
在本文中，我將分析功耗降低所帶來的好處。還將介紹 Virtex-5 器件中所使用的多種技術和結(jié)構(gòu)上的革新，它們能提供功耗最低的解決方案，并且不會在性能上有任何折扣。
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USB2.0攝像頭微處理器硬件設計
USB2.0攝像頭微處理器支持高速USB2.0接口，內(nèi)嵌強勁的圖像后處理單元，JPEG高速編譯碼器，支持高達200萬像素的CMOS傳感器接口和CCD傳感器接口，處理器設計的產(chǎn)品可以實現(xiàn)獨特的運動監(jiān)測功能與臉部追蹤功能
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USB2.0攝像頭微處理器硬件設計
USB2.0攝像頭微處理器支持高速USB2.0接口，內(nèi)嵌強勁的圖像后處理單元，JPEG高速編譯碼器，支持高達200萬像素的CMOS傳感器接口和CCD傳感器接口，處理器設計的產(chǎn)品可以實現(xiàn)獨特的運動監(jiān)測功能與臉部追蹤功能
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